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参数资料
| 型号： | ICS307GI-03LF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 10/14页 |
| 文件大小： | 0K |
| 描述： | IC CLK SOURCE SRL PROGR 16-TSSOP |
| 产品培训模块： | Clock Distibution and Generation 1.0 |
| 标准包装： | 96 |
| 系列： | VersaClock™ II |
| 类型： | 时钟发生器 |
| PLL： | 是 |
| 输入： | 时钟，晶体 |
| 输出： | LVCMOS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:3 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 270MHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3 V ~ 3.6 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 16-TSSOP |
| 包装： | 管件 |
| 产品目录页面： | 1251 (CN2011-ZH PDF) |
| 其它名称： | 307GI-03LF 800-1029 800-1029-5 800-1029-ND |
ICS307-03
SERIALLY PROGRAMMABLE CLOCK SOURCE
SER PROG CLOCK SYNTHESIZER
IDT SERIALLY PROGRAMMABLE CLOCK SOURCE
5
ICS307-03
REV L 032911
Table 5. Output Divider for Output 1
Divide
Value
109 108 107 106 105 104 103
Bits
102
101 100
99
98
97
96
95
Rule
2
XXXX
XXX
X
0
3
XXXX
XXX
X
0
1
4
XXXX
XXX
X
1
0
5
XXXX
XXX
X
0
1
0
6
XXXX
XXX
X
1
0
1
7
XXXX
XXX
X
0
1
8
X
1
0
1
0
apply Rule from Divide Values 14-37
9
XXXX
XXX
X
0
1
0
1
10
X
1
0
1
0
apply Rule from Divide Values 14-37
11
XXXX
XXX
X
1
0
1
12
X
1
0
1
0
apply Rule from Divide Values 14-37
13
XXXX
XXX
X
1
0
1
14
X
1
0
1
0
subtract 6 from the desired divide
value, convert to binary, invert, and
apply to bits 102..98
set bits [97..95] = 100
15
X
1
0
1
0
1
0
36
X
0
1
0
37
X
0
1
0
38
000
0100
0
1
0
1
output divide =
((([109..101]+3)*2)+[98])*2^[100..99]
set bits [95..97] = 101
39
000
0100
0
1
0
1
…
(increments of 1)
set bits [95..97] = 101
1029
111
1111
1
0
1
0
1
( this Rule applies to Divide Values
38-8232)
1030
011
1111
1
0
1
0
1
0
1
1032
011
1111
1
0
1
0
1
…
(increments of 2)
2056
111
1111
1
0
1
0
1
2058
111
1111
1
0
1
0
1
0
1
2060
011
1111
1
0
1
0
1
0
1
2064
011
1111
1
0
1
0
1
…
(increments of 4)
4112
111
1111
1
0
1
0
1
4116
111
1111
1
0
1
0
1
4120
011
1111
1
0
1
0
1
0
1
4128
011
1111
1
0
1
…
(increments of 8)
8224
111
1111
1
0
1
8232
111
1111
1
0
1
0
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