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参数资料
| 型号： | ICS307GI-03LF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 11/14页 |
| 文件大小： | 0K |
| 描述： | IC CLK SOURCE SRL PROGR 16-TSSOP |
| 产品培训模块： | Clock Distibution and Generation 1.0 |
| 标准包装： | 96 |
| 系列： | VersaClock™ II |
| 类型： | 时钟发生器 |
| PLL： | 是 |
| 输入： | 时钟，晶体 |
| 输出： | LVCMOS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:3 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 270MHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3 V ~ 3.6 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 16-TSSOP |
| 包装： | 管件 |
| 产品目录页面： | 1251 (CN2011-ZH PDF) |
| 其它名称： | 307GI-03LF 800-1029 800-1029-5 800-1029-ND |
ICS307-03
SERIALLY PROGRAMMABLE CLOCK SOURCE
SER PROG CLOCK SYNTHESIZER
IDT SERIALLY PROGRAMMABLE CLOCK SOURCE
6
ICS307-03
REV L 032911
Table 6. Output Divider for Output 2
Table 7. Output Divider for Output 3
Bits
Divide Value
117
116
115
114
113
Rule
2
1111
0
output divide = ([117..114]+2)*2^[113])
4
1111
1
6
1110
1
8
1101
1
10
1100
1
12
1011
1
14
1010
1
16
1001
1
18
1000
1
20
0111
1
22
0110
1
24
0101
1
26
0100
1
28
0011
1
30
0010
1
32
0001
1
34
0000
1
Bits
Divide Value
121
120
119
118
94
Rule
2
1111
0
output divide = ([121..118]+2)*2^[94])
4
1111
1
6
1110
1
8
1101
1
10
1100
1
12
1011
1
14
1010
1
16
1001
1
18
1000
1
20
0111
1
22
0110
1
24
0101
1
26
0100
1
28
0011
1
30
0010
1
32
0001
1
34
0000
1
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