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参数资料
| 型号： | ICS307GI-03LF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 12/14页 |
| 文件大小： | 0K |
| 描述： | IC CLK SOURCE SRL PROGR 16-TSSOP |
| 产品培训模块： | Clock Distibution and Generation 1.0 |
| 标准包装： | 96 |
| 系列： | VersaClock™ II |
| 类型： | 时钟发生器 |
| PLL： | 是 |
| 输入： | 时钟，晶体 |
| 输出： | LVCMOS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:3 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 270MHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3 V ~ 3.6 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 16-TSSOP |
| 包装： | 管件 |
| 产品目录页面： | 1251 (CN2011-ZH PDF) |
| 其它名称： | 307GI-03LF 800-1029 800-1029-5 800-1029-ND |
ICS307-03
SERIALLY PROGRAMMABLE CLOCK SOURCE
SER PROG CLOCK SYNTHESIZER
IDT SERIALLY PROGRAMMABLE CLOCK SOURCE
7
ICS307-03
REV L 032911
Table 8. Miscellaneous Control Bits
External Components
The ICS307-03 requires a minimum number of external components for proper operation.
Decoupling Capacitors
TheICS307-03 requires 0.01
μF decoupling capacitors to be connected between each VDD pin and the Ground Plane. The
0.01
μF capacitors must be placed as close to the ICS307-03’s power pins as possible to minimize lead inductance.
Output Termination
The ICS307-03 has advanced output pads that allows the device to achieve very high speed (270 MHz) operation with single
ended clock outputs. The clock outputs on the ICS307-03 are designed to be directly connected to a 50 Ohm transmission
line without the need for any series resistors.
Crystal Selection
A parallel resonant, fundamental mode crystal with a load
(correlation) capacitance of 12 pF should be used. For
crystals with a specified load capacitance greater than 12
pF, additional crystal capacitors may be connected from
each of the pins X1 and X2 to ground as shown in the Block
Diagram on page 1. The value (in pF) of these crystal caps
should be = (CL-12)*2, where CL is the crystal load
capacitance in pF.
For a single ended clock input, connect it to X1 and leave X2 unconnected with no capacitors on either pin.
Initial Output Frequency
ICS307-03 on-chip registers are initially configured to
provide a 1x output clock on the CLK1 output, and 0.5x clock
on CLK2 and CLK3. The output frequency will be the same
as the input clock or crystal for input frequencies from 10 -
50 MHz. This is useful when the ICS307-03 needs to
provide an initial system clock at power-up.
Bit
Function
24~88
Reserved—set to 0
110
OE1—set to 1 to enable CLK1
111
OE2—set to 1 to enable CLK2
112
1 = Normal Operation, 0 = power down feedback counter, charge pump and VCO
122
Crystal Input = 1, Clock Input = 0
123
Selects source for CLK2 (see block diagram)
124
Selects source for CLK3 (see block diagram)
125
Reserved—set to 0
126
Reserved—set to 0
129
OE3—set to 1 to enable CLK3
130
Reserved—set to 0
131
Reserved—set to 0
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PDF描述 |
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| D38999/26FC4SB | CONN PLUG 4POS STRAIGHT W/SCKT |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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