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参数资料
| 型号： | ICS813078BYILF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 23/26页 |
| 文件大小： | 0K |
| 描述： | IC VCXO PLL WIRELESS 64TQFP |
| 标准包装： | 160 |
| 系列： | HiPerClockS™, FemtoClock™ |
| 类型： | 时钟/频率发生器，扇出缓冲器（分配），抖动衰减器，多路复用器 |
| PLL： | 是 |
| 主要目的： | 无线基础架构应用 |
| 输入： | LVDS，LVHSTL，LVPECL，晶体 |
| 输出： | LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 3:9 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 614.4MHz |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-TQFP 裸露焊盘 |
| 供应商设备封装： | 64-TQFP-EP（10x10） |
| 包装： | 托盘 |
ICS813078I
FEMTOCLOCKS VCXO-PLL FREQUENCY GENERATOR
FEMTOCLOCKS VCXO-PLL FREQUENCY GENERATOR
6
ICS813078BYI REV. A OCTOBER 6, 2008
Table 3F. Input Reference Clock Multiplexer (REF_SEL) Configuration Table
The input reference selector should be tied to logic 0, selecting the differential clock inputs, for best signal integrity and lowest phase noise
Table 3G. PLL Bypass (BYPASS) Configuration Table
The BYPASS[1:0] controls should be set to logic LOW level for normal operation. BYPASS = 1x enables the PLL bypass mode for factory
test. In PLL Bypass Mode, the output frequency is divided by NA, NB, or NC dividers.
Table 3H. Fast Lock Mode (FLM) Configuration Table
Figure 1. Recommended Start-up Timing Diagram
Input
Operation
REF_SEL
0 (default)
Selects CLK0, nCLK0 differential input pair as reference frequency.
1
Selects CLK1 single-ended input as reference frequency.
Input
Operation
BYPASS1
BYPASS0
0X
fOUT = ((fREF ÷ P) * MV * MF) ÷ NA, NB, or NC.
VCXO-PLL operation, jitter attenuation and frequency multiplication enabled.
10
fOUT = ((fREF ÷ P) * MV) ÷ NA, NB, or NC.
VCXO-PLL enabled, Femto-PLL bypassed. Jitter attenuation (VCXO-PLL) enabled.
AC specifications do not apply.
1 (default)
fOUT = fREF ÷ NA, NB, or NC.
VCXO-PLL and Femto-PLL bypassed, no jitter attenuation and frequency multiplication.
AC specifications do not apply.
Input
Operation
FLM
0 (default)
Normal operation.
1
Fast PLL lock operation. Use this mode only during startup to decrease PLL lock time.
Fast Lock Mode
(High VCXO-PLL Bandwidth)
Nominal VCXO-PLL Bandwidth
VCXO-PLL Locked
VCXO-PLL Acquires Lock
tLOCK
LOCK
FLM
0V
VCC = 3.3V
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PDF描述 |
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