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参数资料
| 型号： | ICS813078BYILF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 24/26页 |
| 文件大小： | 0K |
| 描述： | IC VCXO PLL WIRELESS 64TQFP |
| 标准包装： | 160 |
| 系列： | HiPerClockS™, FemtoClock™ |
| 类型： | 时钟/频率发生器，扇出缓冲器（分配），抖动衰减器，多路复用器 |
| PLL： | 是 |
| 主要目的： | 无线基础架构应用 |
| 输入： | LVDS，LVHSTL，LVPECL，晶体 |
| 输出： | LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 3:9 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 614.4MHz |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-TQFP 裸露焊盘 |
| 供应商设备封装： | 64-TQFP-EP（10x10） |
| 包装： | 托盘 |
ICS813078I
FEMTOCLOCKS VCXO-PLL FREQUENCY GENERATOR
FEMTOCLOCKS VCXO-PLL FREQUENCY GENERATOR
7
ICS813078BYI REV. A OCTOBER 6, 2008
Table 3I. Reset (nMR) Configuration Table
Table 3J. Output Disable (nSTOPA) Configuration Table.
Table 3K. Output Disable (nSTOPB) Configuration Table.
Table 3L. Output Disable (nSTOPC) Configuration Table.
Table 3M. PLL Lock Status Output (LOCK_DT) Configuration Table.
Input
Operation
nMR
0
The Femto-PLL is reset.
1 (default)
Normal operation.
Input
Operation
nSTOPA
0
QA[2:0]/nQA[2:0] outputs are stopped in logic LOW state. The assertion of nSTOPA is asynchronous
to the internal clock signal and may cause an output runt pulse.
1 (default)
Normal operation and outputs enabled.
Input
Operation
nSTOPB
0
QB[1:0] / nQB[1:0] outputs are stopped in logic LOW state. The assertion of nSTOPB is
asynchronous to the internal clock signal and may cause an output runt pulse.
1 (default)
Normal operation and outputs enabled.
Input
Operation
nSTOPC
0
QC[3:0] outputs are stopped in logic LOW state. The assertion of nSTOPC is asynchronous to the
internal clock signal and may cause an output runt pulse.
1 (default)
Normal operation and outputs enabled.
Conditions
Output
LOCK_DT
Locked
Constantly HIGH.
Unlocked
HIGH with occasional LOW pulses.
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PDF描述 |
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