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参数资料
| 型号： | ICS952623YGLFT |
| 元件分类： | 时钟产生/分配 |
| 英文描述： | 400 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO56 |
| 封装： | 6.10 MM, 0.50 MM PITCH, MO-153, TSSOP-56 |
| 文件页数： | 5/27页 |
| 文件大小： | 321K |
| 代理商： | ICS952623YGLFT |
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13
Integrated
Circuit
Systems, Inc.
ICS952623
Advance Information
0758—02/08/05
I
2C Table: Output Control and Fix Frequency Register
Pin #
Name
Control Function
Type0
1
PWD
Bit 7
Test Clock Mode
-
Disable
Enable
0
Bit 6
RESERVED
-
0
Bit 5
RESERVED
FS_A and FS_B
Operation
-
Normal
Test Mode
0
Bit 4
RESERVED
SRC Frequency
Select
-
100MHz
200MHz
0
Bit 3
Spread Type
Down/Center
-
Down
Center
0
Bit 2
Spread Spectrum Mode
Spread
OFF
Spread
ON
0
Bit 1
REF1
Output Control
RW
Disable
Enable
1
Bit 0
REF0
Output Control
RW
Disable
Enable
1
I
2C Table: Vendor & Revision ID Register
Pin #
Name
Control Function
Type0
1
PWD
Bit 7
RID3
R
-
0
Bit 6
RID2
R
-
0
Bit 5
RID1
R
-
0
Bit 4
RID0
R
-
0
Bit 3
VID3
R
-
0
Bit 2
VID2
R
-
0
Bit 1
VID1
R
-
0
Bit 0
VID0
R
-
1
I
2C Table: Byte Count Register
Pin #
Name
Control Function
Type
0
1
PWD
Bit 7
BC7
RW
-
0
Bit 6
BC6
RW
--
0
Bit 5
BC5
RW
-
0
Bit 4
BC4
RW
-
0
Bit 3
BC3
RW
--
1
Bit 2
BC2
RW
-
0
Bit 1
BC1
RW
--
0
Bit 0
BC0
RW
-
0
1,2,7,8,9,12,13,14,
15,18,19,20,22,23,2
6,27,29,31,32,37,38
,40,41,43,44,46,47
-
40,41,43,44,46,47
Byte 6
2
1
37,38
7,8,9,12,13,14,15,1
8,19,20,22,23,26,27
,29,31,32,37,38,40,
41,43,44,46,47
Byte 7
-
REVISION ID
-
VENDOR ID
-
Byte 8
-
Writing to this register
will configure how
many bytes will be
read back, default is
08 = 8 bytes.
-
相关PDF资料 |
PDF描述 |
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