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参数资料
| 型号： | IDT70V05L55G |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 12/22页 |
| 文件大小： | 0K |
| 描述： | IC SRAM 64KBIT 55NS 68PGA |
| 标准包装： | 3 |
| 格式 - 存储器： | RAM |
| 存储器类型： | SRAM - 双端口，异步 |
| 存储容量： | 64K (8K x 8) |
| 速度： | 55ns |
| 接口： | 并联 |
| 电源电压： | 3 V ~ 3.6 V |
| 工作温度： | 0°C ~ 70°C |
| 封装/外壳： | 68-BPGA |
| 供应商设备封装： | 68-PGA（29.46x29.46） |
| 包装： | 托盘 |
| 其它名称： | 70V05L55G |
IDT70V05S/L
High-Speed 3.3V 8K x 8 Dual-Port Static RAM
Industrial and Commercial Temperature Ranges
Timing Waveform of Semaphore Read after Write Timing, Either Side (1)
t SAA
t OH
A 0 -A 2
VALID ADDRESS
VALID ADDRESS
SEM
DATA 0
t AW
t WR
t EW
t DW
DATA IN VALID
t SOP
t ACE
DATA OUT
VALID (2)
R/ W
t AS
t WP
t DH
OE
Write Cycle
t SWRD
t SOP
Read Cycle
t AOE
2941 drw 10
NOTE:
1. CE = V IH for the duration of the above timing (both write and read cycle).
2. “DATA OUT VALID” represents all I/O's (I/O 0 -I/O 7 ) equal to the semaphore value.
Timing Waveform of Semaphore Write Contention (1,3,4)
A 0"A" -A 2"A"
MATCH
(2)
SIDE
(2)
SIDE
"A"
"B"
R/ W "A"
SEM "A"
A 0"B" -A 2"B"
R/ W "B"
SEM "B"
MATCH
t SPS
2941 drw 11
NOTES:
1. D OR = D OL = V IL , CE R = CE L = V IH , Semaphore Flag is released from both sides (reads as ones from both sides) at cycle start.
2. “A” may be either left or right port. “B” is the opposite port from “A”.
3. This parameter is measured from R/ W “A” or SEM “A” going HIGH to R/ W “B” or SEM “B” going HIGH.
4. If t SPS is not satisfied, the semaphore will fall positively to one side or the other, but there is no guarantee which side will obtain the flag.
12
6.42
相关PDF资料 |
PDF描述 |
|---|---|
| IDT70V06L55G | IC SRAM 128KBIT 55NS 68PGA |
| IDT70V07L35G | IC SRAM 256KBIT 35NS 68PGA |
| IDT70V08S15PF | IC SRAM 512KBIT 15NS 100TQFP |
| IDT70V09L20PFI | IC SRAM 1MBIT 20NS 100TQFP |
| IDT70V18L20PFI | IC SRAM 576KBIT 20NS 100TQFP |
相关代理商/技术参数 |
参数描述 |
|---|---|
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