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参数资料
| 型号： | IDT70V5388S166BGI |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 15/29页 |
| 文件大小： | 0K |
| 描述： | IC SRAM 1.125MBIT 166MHZ 272BGA |
| 标准包装： | 20 |
| 格式 - 存储器： | RAM |
| 存储器类型： | SRAM - 四端口，同步 |
| 存储容量： | 1.125M（64K x 18） |
| 速度： | 166MHz |
| 接口： | 并联 |
| 电源电压： | 3.15 V ~ 3.45 V |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 272-BBGA |
| 供应商设备封装： | 272-PBGA（27x27） |
| 包装： | 托盘 |
| 其它名称： | 70V5388S166BGI |
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IDT70V5388/78
3.3V 64/32K x 18 Synchronous FourPort? Static RAM
Industrial and Commercial Temperature Ranges
Timing Waveform of Port A Write to Port B Read (1,2,4)
CLK "A"
R/ W "A"
t SW
t SA
t HW
t HA
ADDRESS "A"
DATA IN"A"
MATCH
t SD
t HD
VALID
NO
MATCH
t CCS (3)
CLK "B"
t CD2
R/ W "B"
t SW
t SA
t HW
t HA
ADDRESS "B"
DATA OUT"B"
NOTES:
MATCH
NO
MATCH
VALID
t DC
5649 drw 10
1. CE 0 , LB , UB , and CNTLD = V IL ; CE 1 , CNTINC , CNTRST , MRST , MKLD , MKRD and CNTRD = V IH .
2. OE = V IL for Port "B", which is being read from. OE = V IH for Port "A", which is being written to.
3. If t CCS < minimum specified, then data from Port "B" read is not valid until following Port "B" clock cycle (ie, time from write to valid read on opposite
port will be t CCS + 2 t CYC2 + t CD2 ). If t CCS > minimum, then data from Port "B" read is available on first Port "B" clock cycle (ie, time from write to
valid read on opposite port will be t CCS + t CYC2 + t CD2 ).
4. All timing is the same for all ports. Port "A" may be any port. Port "B" is any other port on the device.
Timing Waveform of Read-to-Write-to-Read ( OE = V IL ) (2)
t CYC2
CLK
CE 0
t CH2
t CL2
CE 1
t SC
t SB
t HC
t HB
LB, UB
t SW t HW
R/ W
t SW t HW
(3)
ADDRESS
An
An +1
An + 2
An + 2
An + 3
An + 4
DATA IN
t SA
t HA
t SD t HD
Dn + 2
DATA OUT
(1)
t CD2
Qn
t CKHZ
t CKLZ
t CD2
Qn + 3
NOP
NOTES:
READ
(4)
WRITE
READ
5649 drw 11
,
1. Output state (High, Low, or High-impedance) is determined by the previous cycle control signals.
2. CNTLD = V IL ; CNTINC , and CNTRST , MRST , MKLD , MKRD and CNTRD = V IH . "NOP" is "No Operation".
3. Addresses do not have to be accessed sequentially since CNTLD = V IL constantly loads the address on the rising edge of the CLK; numbers
are for reference use only.
4. "NOP" is "No Operation." Data in memory at the selected address may be corrupted and should be re-written to guarantee data integrity.
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6.42
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