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参数资料
| 型号： | IDT72V3612L15PF8 |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 21/24页 |
| 文件大小： | 0K |
| 描述： | IC FIFO 64X36X2 15NS 120QFP |
| 标准包装： | 750 |
| 系列： | 72V |
| 功能： | 异步 |
| 存储容量： | 4.6K（64 x 36 x2） |
| 数据速率： | 67MHz |
| 访问时间： | 15ns |
| 电源电压： | 3 V ~ 3.6 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 120-LQFP |
| 供应商设备封装： | 120-TQFP（14x14） |
| 包装： | 带卷 (TR) |
| 其它名称： | 72V3612L15PF8 |
6
IDT72V3612 3.3V, CMOS SyncBiFIFOTM
64 x 36 x 2
COMMERCIALTEMPERATURERANGE
DETERMINING ACTIVE CURRENT CONSUMPTION AND POWER DISSIPATION
The ICC(f) current for the graph in Figure 1 was taken while simultaneously reading and writing the FIFO on the IDT72V3612 with CLKA and CLKB set to
fS. All data inputs and data outputs change state during each clock cycle to consume the highest supply current. Data outputs were disconnected to normalize
the graph to a zero-capacitance load. Once the capacitance load per data-output channel is known, the power dissipation can be calculated with the equation
below.
CALCULATING POWER DISSIPATION
With ICC(f) taken from Figure 1, the maximum power dissipation (PT) of the IDT72V3612 may be calculated by:
PT = VCC x ICC(f) +
Σ(CL x (VOH - VOL)2 x fO)
N
where:
N
=
number of outputs = 36
CL
=
output capacitance load
fo
=
switching frequency of an output
VOH
=
output HIGH level voltage
VOL
=
output LOW level voltage
When no reads or writes are occurring on this device, the power dissipated by a single clock (CLKA or CLKB) input running at frequency fS is calculated
by:
PT = VCC x fS x 0.025 mA/MHz
Figure 1. Typical Characteristics: Supply Current (ICC) vs. Clock Frequency (fS)
010
20
30
40
50
60
70
0
25
50
75
100
125
150
VCC = 3.3V
fS
Clock Frequency MHz
ICC(f)
Supply
Current
mA
fdata = 1/2 fS
TA = 25
°C
CL = 0 pF
VCC = 3.0V
4663 drw 04
VCC = 3.6V
80
90
175
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