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参数资料
| 型号： | IDT72V3612L15PF8 |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 7/24页 |
| 文件大小： | 0K |
| 描述： | IC FIFO 64X36X2 15NS 120QFP |
| 标准包装： | 750 |
| 系列： | 72V |
| 功能： | 异步 |
| 存储容量： | 4.6K（64 x 36 x2） |
| 数据速率： | 67MHz |
| 访问时间： | 15ns |
| 电源电压： | 3 V ~ 3.6 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 120-LQFP |
| 供应商设备封装： | 120-TQFP（14x14） |
| 包装： | 带卷 (TR) |
| 其它名称： | 72V3612L15PF8 |
15
IDT72V3612 3.3V, CMOS SyncBiFIFOTM
64 x 36 x 2
COMMERCIALTEMPERATURERANGE
NOTE:
1. tSKEW1 is the minimum time between a rising CLKA edge and a rising CLKB edge for EFB to transition HIGH in the next CLKB cycle. If the time between the rising CLKA edge and
rising CLKB edge is less than tSKEW1, then the transition of EFB HIGH may occur one CLKB cycle later than shown.
Figure 7. EFB
EFB
EFB Flag Timing and First Data Read when FIFO1 is Empty
CSA
W/
RA
MBA
FFA
A0 - A35
CLKB
EFB
CSB
W/
RB
MBB
ENA
ENB
B0 -B35
CLKA
12
4659 drw 10
tCLKH
tCLKL
tCLK
tENS3
tENS2
tENH3
tENH2
tDS
tDH
tSKEW1
tCLK
tCLKL
tENS2
tENH2
tA
W1
FIFO1 Empty
LOW
HIGH
LOW
tCLKH
W1
HIGH
(1)
tREF
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PDF描述 |
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参数描述 |
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