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参数资料
| 型号： | IDT79RC32K438-233BBI |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 25/59页 |
| 文件大小： | 0K |
| 描述： | IC MPU 32BIT CORE 233MHZ 416-BGA |
| 标准包装： | 40 |
| 系列： | Interprise™ |
| 处理器类型： | MIPS32 32-位 |
| 速度： | 233MHz |
| 电压： | 1.2V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 416-BGA |
| 供应商设备封装： | 416-PBGA（27x27） |
| 包装： | 托盘 |
| 其它名称： | 79RC32K438-233BBI |
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31 of 59
May 25, 2004
IDT 79RC32438
Signal
Symbol Reference
Edge
200MHz 233MHz 266MHz 300MHz
Unit Conditions
Timing
Diagram
Reference
Min
Max
Min
Max
Min
Max
Min
Max
I2C1
1. For more information, see the I2C-Bus specification by Philips Semiconductor.
SCL
Frequency none
0
100
0
100
0
100
0
100
kHz
100 KHz
See Figure 16.
Thigh_12a,
Tlow_12a
4.0
—
4.0
—
4.0
—
4.0
—
s
Trise_12a
—
1000
—
1000
—
1000
—
1000
ns
Tfall_12a
—
300
—
300
—
300
—
300
ns
SDA
Tsu_12b
SCL rising
250
—
250
—
250
—
250
—
ns
Thld_12b
0
3.45
0
3.45
0
3.45
0
3.45
s
Trise_12b
—
1000
—
1000
—
1000
—
1000
ns
Tfall_12b
—
300
—
300
—
300
—
300
ns
Start or repeated start
condition
Tsu_12c
SDA falling
4.7
—
4.7
—
4.7
—
4.7
—
s
Thld_12c
4.0
—
4.0
—
4.0
—
4.0
—
s
Stop condition
Tsu_12d
SDA rising
4.0
—
4.0
—
4.0
—
4.0
—
s
Bus free time between
a stop and start condi-
tion
Tdelay_12e
4.7
—
4.7
—
4.7
—
4.7
—
s
SCL
Frequency none
0
400
0
400
0
400
0
400
kHz
400 KHz
Thigh_12a,
Tlow_12a
0.6
—
0.6
—
0.6
—
0.6
—
s
Trise_12a
—
300
—
300
—
300
—
300
ns
Tfall_12a
—
300
—
300
—
300
—
300
ns
SDA
Tsu_12b
SCL rising
100
—
100
—
100
—
100
—
ns
Thld_12b
0
0.9
0
0.9
0
0.9
0
0.9
s
Trise_12b
—
300
—
300
—
300
—
300
ns
Tfall_12ba
—
300
—
300
—
300
—
300
ns
Start or repeated start
condition
Tsu_12c
SDA falling
0.6
—
0.6
—
0.6
—
0.6
—
s
Thld_12c
0.6
—
0.6
—
0.6
—
0.6
—
s
Stop condition
Tsu_12d
SDA rising
0.6
—
0.6
—
0.6
—
0.6
—
s
Bus free time between
a stop and start condi-
tion
Tdelay_12e
1.3
—
1.3
—
1.3
—
1.3
—
s
Table 11 I2C AC Timing Characteristics
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