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参数资料
| 型号： | IDT79RC32T336-150BCG |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 20/44页 |
| 文件大小： | 0K |
| 描述： | IC MPU 32BIT CORE 150MHZ 256-BGA |
| 标准包装： | 90 |
| 系列： | Interprise™ |
| 处理器类型： | MIPS32 32-位 |
| 速度： | 150MHz |
| 电压： | 2.5V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 256-LBGA |
| 供应商设备封装： | 256-CABGA（17x17） |
| 包装： | 托盘 |
| 其它名称： | 79RC32T336-150BCG |
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October 4, 2005
RC32336
Figure 14 PCI AC Timing Waveform — PCI Reset in Satellite Mode
Signal
Symbol Reference
Edge
150MHz
Unit
Conditions
Timing
Diagram
Reference
Min
Max
SPI1
1. In SPI mode, the SCK period and sampling edge are programmable. In PCI mode, the SCK period is fixed and the sampling edge is rising.
SCK
Tper_12a
None
—
1920
ns
33 MHz PCI
See Figures 15
through 18
Tper_12a
—
960
ns
66 MHz PCI
Tper_12a
100
166667
ns
SPI
Thigh_12a,
Tlow_12a
930
990
ns
33 MHz PCI
Thigh_12a,
Tlow_12a
465
495
ns
66 MHz PCI
Thigh_12a,
Tlow_12a
40
83353
ns
SPI
SDI
Tsu_12b
SCK rising or
falling
60
—
ns
SPI or PCI
Thld_12b
60
—
ns
SDO
Tdo_12c
SCK rising or
falling
0
60
ns
SPI or PCI
PCIEECS2
2. PCIEECS is the PCI serial EEPROM chip select. It is an alternate function of PCIGNTN[1].
Tdo_12d
SCK rising or
falling
060
ns
PCI
SCK, SDI, SDO3
3. In Bit I/O mode, SCK, SDI, and SDO must meet the setup and hold times if they are synchronous or the minimum pulse width if they are asynchro-
nous.
Tpw_12e
None
2(CLK)
—ns
Table 11 SPI AC Timing Characteristics
Tdz_10e
Tpw_10e
warm reset
CLK
PCIRSTN (input)
RSTN
MDATA[15:0]
PCI bus signals
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PDF描述 |
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