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参数资料
| 型号： | IDT79RC32T336-150BCG |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 27/44页 |
| 文件大小： | 0K |
| 描述： | IC MPU 32BIT CORE 150MHZ 256-BGA |
| 标准包装： | 90 |
| 系列： | Interprise™ |
| 处理器类型： | MIPS32 32-位 |
| 速度： | 150MHz |
| 电压： | 2.5V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 256-LBGA |
| 供应商设备封装： | 256-CABGA（17x17） |
| 包装： | 托盘 |
| 其它名称： | 79RC32T336-150BCG |
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October 4, 2005
RC32336
Voltage Sense Signal Timing
Figure 22 Voltage Sense Signal Timing
The target system must ensure that Trise is obeyed after the system reaches 0.5V (Tactive), so the probe can use this value to determine when the
target has powered-up. The probe is allowed to measure the Trise time from a higher value than Tactive (but lower than Vcc I/O minimum) because the
stable indication in this case comes later than the time when target power is guaranteed to be stable. If JTAG_TRST_N is asserted by a pulse at
power-up, this reset must be completed after Trise. If JTAG_TRST_N is asserted by a pull-down resistor, the probe will control JTAG_TRST_N. At
power-down, no power is indicated to the probe when Vcc I/O drops under the Tactive value, which the probe uses to stop driving the input signals,
except for the probe RST*.
A
AC Test Conditions
C Test Conditions
Figure 23 Output Loading for AC Timing
Phase-Locked Loop (PLL)
The processor aligns the pipeline clock, PClock, to the master input clock (CLK) by using an internal phase-locked loop (PLL) circuit that generates
aligned clocks. Inherently, PLL circuits are only capable of generating aligned clocks for master input clock (CLK) frequencies within a limited range.
PLL Analog Filter
The storage capacitor required for the Phase-Locked Loop circuit is contained in the RC32336. However, it is recommended that the system
designer provide a filter network of passive components for the PLL power supply.
V
CCPLL (circuit power) and VSSPLL (circuit ground) should be isolated from VCC Core (core power) and VSS (common ground) with a filter circuit
such as the one shown in Figure 24.
VSENSE
Trise_16f
Tactive
1.5V
Parameter
Value
Units
Input pulse levels
0 to 3.0
V
Input rise/fall
3.5
ns
Input reference level
1.5
V
Output reference levels
1.5
V
AC test load
35
pF
RC32336
Output
.
50
50
Test
Point
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PDF描述 |
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