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参数资料
| 型号： | IDT82V3280 |
| 厂商： | Integrated Device Technology, Inc. |
| 英文描述： | WAN PLL |
| 中文描述： | 广域网锁相环 |
| 文件页数： | 32/167页 |
| 文件大小： | 1039K |
| 代理商： | IDT82V3280 |
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IDT82V3280
WAN PLL
Functional Description
32
June 19, 2006
Figure 7. T0 Selected Input Clock vs. DPLL Automatic Operating Mode
Notes to
Figure 7
:
1. Reset.
2. An input clock is selected.
3. The T0 selected input clock is disqualified
AND
No qualified input clock is available.
4. The T0 selected input clock is switched to another one.
5. The T0 selected input clock is locked (the T0_DPLL_LOCK bit is ‘1’).
6. The T0 selected input clock is disqualified
AND
No qualified input clock is available.
7. The T0 selected input clock is unlocked (the T0_DPLL_LOCK bit is ‘0’).
8. The T0 selected input clock is locked again (the T0_DPLL_LOCK bit is ‘1’).
9. The T0 selected input clock is switched to another one.
10. The T0 selected input clock is locked (the T0_DPLL_LOCK bit is ‘1’).
11. The T0 selected input clock is disqualified
AND
No qualified input clock is available.
12. The T0 selected input clock is switched to another one.
13. The T0 selected input clock is disqualified
AND
No qualified input clock is available.
14. An input clock is selected.
15. The T0 selected input clock is switched to another one.
Free-Run mode
1
Pre-Locked
mode
2
3
4
Locked
mode
5
Lost-Phase
mode
Holdover
mode
7
8
Pre-Locked2
mode
13
14
15
6
12
11
9
10
相关PDF资料 |
PDF描述 |
|---|---|
| IDT82V3280DQ | WAN PLL |
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相关代理商/技术参数 |
参数描述 |
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