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参数资料
| 型号： | IDT82V3280 |
| 厂商： | Integrated Device Technology, Inc. |
| 英文描述： | WAN PLL |
| 中文描述： | 广域网锁相环 |
| 文件页数： | 57/167页 |
| 文件大小： | 1039K |
| 代理商： | IDT82V3280 |
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IDT82V3280
WAN PLL
Microprocessor Interface
57
June 19, 2006
Figure 25. Serial Write Timing Diagram
Table 40: Write Timing Characteristics in Serial Mode
Symbol
Parameter
Min
Typ
Max
Unit
T
t
in
t
out
t
su1
t
su2
t
pw1
t
pw2
t
h1
t
h2
One cycle time of the master clock
Delay of input pad
12.86
5
ns
ns
Delay of output pad
5
ns
Valid SDI to valid SCLK setup time
Valid
CS
to valid SCLK setup time
4
ns
14
ns
SCLK pulse width low
3.5T
ns
SCLK pulse width high
3.5T
ns
Valid SDI after valid SCLK hold time
Valid
CS
after valid SCLK hold time
Time between consecutive Write-Write or Write-Read accesses
(
CS
rising edge to
CS
falling edge)
6
ns
5
ns
t
TI
10
ns
CS
SCLK
SDI
SDO
High-Z
R/
W
A0
A1
A2
A3
A4
A5
A6
D0
D1
D2
D3
D4
D5
D6
D7
t
su2
t
su1
t
h1
t
h2
t
pw2
t
pw1
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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