参数资料
| 型号： | ISL35822LPIK |
| 厂商： | Intersil |
| 文件页数： | 10/75页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK/DATA RECOVERY 192EBGA-B |
| 标准包装： | 90 |
| 类型： | 时钟和数据恢复（CDR），多路复用器 |
| PLL： | 无 |
| 输入： | CML |
| 输出： | CML，CMOS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 8:8 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 1.59Gbps |
| 电源电压： | 1.3 V ~ 1.41 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 192-EBGA |
| 供应商设备封装： | 192-EBGA-B（17x17） |
| 包装： | 托盘 |
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18
D
CLK
CLR
LS_ALARM
LASI
LS ALARM
Masked
TX ALARM
Masked
RX ALARM
Masked
GPIO
ALARM
Masked
TX_ALARM
REGISTER 1.9003h.[6:0] RX_ALARM_STATUS
REGISTER 1.9004h.[10:0] TX_ALARM_STATUS
Latch on high
Clear on read
R
E
G
4
.8.
11
CX
4
LX
4
LX
4
CX
4
LX
4
CX
4
LX
4
CX
4
R
E
G
3
.8.
11
R
E
G
1
.8.
11
OPTX
LOP
OPT
TEMP
OPTX
LBC
CX
4
LX
4
CX
4
LX
4
CX
4
LX
4
REG 1.A070h[7:0]
TX_FLAG
REG 1.9006h[7:0]
TX_FLAG CONTROL
Q
Clock on
any
change
LINK
STATUS
REG. 1.10.0
REG. 3.24.12
REG. 4.24.12
Clear on Read of 1.9005
REG 1.9002h[3:0]
LASI CONTROL
REG 1.9005h[3:0]
LASI STATUS
REGISTER 1.9001h[10:0] TX_ALARM CONTROL
REGISTER 1.9000h[6:0] RX_ALARM CONTROL
RE
G
4.8.
10
RX_FLAG
REG 1.A074h[7:6]
RX_FLAG
REG 1.9007h[7:6]
RX_FLAG CONTROL
LX4
CX4
RE
G
3.8.
10
RE
G
1.8.
10
CX4
LX4
OPRX
OP
RE
G
1
.10.
0
REG
1.C01Dh.3
Latch on high
Clear on read
GPIO
[4:0]
REG 1.C012h.[12:8]
GPIO POLARITY
REG 1.C012h.[4:0]
GPIO-LASI EN
REG 1.C01Dh.2:0
ALARM PIN POLARITY
R
E
G
1.
C011
h.
[1
2:
8]
G
P
IO
IN
P
U
T
Latch
hi
Legend
Selector for
CX4 vs LX4
External Pad
LX4
CX4
LASI
Ch
an
ge
RX_ALARM
GPIO->LASI
REG
1.C012h.13
POLARITY
TX_
FAULT
PHY XS
BYTE
SYNCH
REG.
4.24.3:0
REG.
4.C00Ah.
3:0
PHY XS
LOS
(SIG DET)
REG.
4.C007h.
11:8
PHY XS
FIFO
ERROR
REG.
4.C007h.
7:4
PHY XS
CODE
ERROR
TX_FLAG
REG
3.24
[3:0]
PCS
BYTE
SYNCH
REG.
3.C007h.
11:8
PCS
FIFO
ERROR
REG.
3.C007h.
7:4
PCS
CODE
ERROR
See IEEE
FIGURE 5. LASI EQUIVALENT SCHEMATIC
(See Also Figure 4)
ISL35822
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