参数资料
型号: ISL35822LPIK
厂商: Intersil
文件页数: 51/75页
文件大小: 0K
描述: IC CLOCK/DATA RECOVERY 192EBGA-B
标准包装: 90
类型: 时钟和数据恢复(CDR),多路复用器
PLL:
输入: CML
输出: CML,CMOS
电路数: 1
比率 - 输入:输出: 8:8
差分 - 输入:输出: 是/是
频率 - 最大: 1.59Gbps
电源电压: 1.3 V ~ 1.41 V
工作温度: 0°C ~ 70°C
安装类型: 表面贴装
封装/外壳: 192-EBGA
供应商设备封装: 192-EBGA-B(17x17)
包装: 托盘
55
Pin Specifications
Table 94. CLOCK PINS
PIN#
NAME
TYPE
DESCRIPTION
T9/T8
RFCP/RFCN
Input
LVPECL
Differential Reference Input Clock. The reference input clock frequency is line rate
clock frequency divided by 20 (full rate mode) or 10 (half rate mode). The pins are
internally biased at VDDA/2, and should be AC coupled.
C10
TXCLK20
Output
1.5V CMOS
Transmit Clock Output. Divided-by-20 transmit clock output.
Table 95. XAUI (XENPAK/XPAK/X2) SIDE SERIAL DATA PINS
PIN#
NAME
TYPE
DESCRIPTION
T14/T15
TXP0P/TXP0N
Output CML
Transmit Differential Pairs, Lane 0 to 3. CML High speed serial outputs.
P14/P15
TXP1P/TXP1N
M14/M15
TXP2P/TXP2N
K14/K15
TXP3P/TXP3N
H14/H15
RXP0P/RXP0N
Input CML
Receive Differential Pairs, Lane 0 to 3. CML High speed serial inputs. Differentially
terminated at 100
F14/F15
RXP1P/RXP1N
D14/D15
RXP2P/RXP2N
B14/B15
RXP3P/RXP3N
Table 96. PMA/PMD (CX4/LX4) SIDE SERIAL DATA PINS
PIN#
NAME
TYPE
DESCRIPTION
A2/A3
TCX0P/TCX0N
Output CML
Transmit Differential Pairs, Lane 0 to 3. CML High speed serial outputs.
C2/C3
TCX1P/TCX1N
E2/E3
TCX2P/TCX2N
G2/G3
TCX3P/TCX3N
R2/R3
RCX0P/RCX0N
Input CML
Receive Differential Pairs, Lane 0 to 3. CML High speed serial inputs. Differentially
terminated at 100
N2/N3
RCX1P/RCX1N
L2/L3
RCX2P/RCX2N
J2/J3
RCX3P/RCX3N
Table 97. JTAG INTERFACE PINS
PIN#
NAME
TYPE
DESCRIPTION
D12
TDI
Input (with pullup)
JTAG Input Data. 1.5V CMOS
B12
TDO
Output (open drain)
JTAG Output Data. 1.5V CMOS, 2.5V Tolerant
D8
TMS
Input (with pullup)
JTAG Mode Select. 1.5V CMOS
C12
TCLK
Input (with pulldown)
JTAG Clock. 1.2V CMOS, 2.5V Tolerant, with Schmitt trigger
C8
TRSTN
Input (with pullup)
JTAG Reset. 1.5V CMOS
ISL35822
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