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参数资料
型号： ISL5416EVAL1
厂商： Intersil
文件页数： 67/71页
文件大小： 0K
描述： EVALUATION PLATFORM FOR ISL5416
标准包装： 1
类型： 降频器
适用于相关产品： ISL5416
已供物品： 板
ISL5416
TABLE 86. AGC BIT WEIGHTS (Continued)
AGC BIT
WEIGHTS
F E D C B A 9 8 7 6 5 4 3 2 1 0 . 1 2 3 4 5 6 7 8 9 0 1 2 3 4 5 6 7 8 9 0 1 2 3 4 5 6 7 8 9
BARREL SHIFTER SHIFT
EEEE = 0
EEEE = 4
EEEE = 8
EEEE = 15
BS OUT /
MULT IN
MULT
1.0 <= M<= 2.0
MULT OUT
S. 1 2 3 4 5 6 7 8 9 0 1 2 3 4 5 6 7 8 9 0 1 2 3
S. 1 2 3 4 5 6 7 8 9 0 1 2 3 4 5 6 7 8 9 0 1 2 3 G G G G
S. 1 2 3 4 5 6 7 8 9 0 1 2 3 4 5 6 7 8 9 0 1 2 3 G G G G G G G G
S. 1 2 3 4 5 6 7 8 9 0 1 2 3 4 5 6 7 8 9 0 1 2 3 G G G G G G G G G G G G G G G
------------SATURATE ON OVERFLOW---------
--
S. 1 2 3 4 5 6 7 8 9 0 1 2 3 4 5 6 7 8 9 0 1 2 3
G V 1 2 3 4 5 6 7 8 9 0 1 2 3 4
S 0 1 2 3 4 5 6 7 8 9 0 1 2 3 4 5 6 7 8 9 0 1 2 3
SATURATE BASED ON SHIFT AND MULT OUT:
FEEDBACK
PATH;
OUTPUTS I/Q
MAG IN
S. 1 2 3 4 5 6 7 8 9 0 1 2 3 4 5 6 7 8 9 0 1 2 3
S. 1 2 3 4 5 6 7 8 9 0 1 2 3 4 5 6 7 8 9 0 1 2 3
MAGNITUDE (G = 1.647, MAX IN = 1.414, MAX OUT = 2.33):
G 1 0 1 2 3 4 5 6 7 8 9 0 1 2 3 4 5 6 7 8 9 0 1 2 3
THRESHOLD
MEAN ERROR
MEDIAN
ERROR
LG MANTISSA
LG MANT
MULT OUT
LG EXP SHIFT
=0
LG EXP SHIFT
=4
LG EXP SHIFT
=8
LG EXP SHIFT
= 15
LG ACCUM
LL / UL
OUTPUT FWD
GAIN
OUTPUT uP /
2 1 0 1 2 3 4 5 6 7 8 9 0 1 2 3
S 1 0 1 2 3 4 5 6 7 8 9 0 1 2 3
G G G. V G G G G G G G G G G G G
V V V. V G G G G G G G G G G G G
G. 1 2 3 4
S 1 0 1 2 3 4 5 6 7 8 9 0 1 2 3 4 5
S S S S S S S S S S S S S S S S S 1 0 1 2 3 4 5 6 7 8 9 0 1 2 3 4
S S S S S S S S S S S S S 1 0 1 2 3 4 5 6 7 8 9 0 1 2 3 4 5 G G G
S S S S S S S S S 1 0 1 2 3 4 5 6 7 8 9 0 1 2 3 4 5 G G G G G G G
S S 1 0 1 2 3 4 5 6 7 8 9 0 1 2 3 4 5 G G G G G G G G G G G G G G
3 2 1 0. 1 2 3 4 5 6 7 8 9 0 1 2 3 4 5 6 7 8 9 0 1 2 3 4 5 6 7 8 9
G G G 0 1 2 3 4 5 6 7 8 9 0 1 2 3 4 5
E E E E M M M M M M M M M M M M M M
G E E E E M M M M M M M M M M M
PARALLEL
BIT WEIGHTS (dB); MAX GAIN = 96.3293 dB
4 2 1
8 4 2 6 3 1 0 0 0 0 0 0 0 0 0 0 0 0
S = SIGN
.
.
.
.
.
.
.
.
.
.
.
.
.
.
.
.
.
.
G = LOGIC 0
E=EXPONENT
M=
MANTISSA
V = LOGIC 1
67
1 0 0 0 0 5 7 3 1 0 0 0 0 0 0 0 0 0
6 8 4 2 1 0 5 7 8 9 4 2 1 0 0 0 0 0
4 2 1 0 0 5 2 6 8 4 7 3 1 5 2 1 0 0
8 4 2 6 3 1 5 3 1 1 0 5 7 9 9 5 7 4
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