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参数资料
| 型号： | ISL6726AAZ |
| 厂商： | Intersil |
| 文件页数： | 17/20页 |
| 文件大小： | 0K |
| 描述： | IC REG CTRLR ISO PWM CM 20-QSOP |
| 标准包装： | 58 |
| PWM 型： | 电流模式 |
| 输出数： | 1 |
| 频率 - 最大： | 2MHz |
| 占空比： | 100% |
| 电源电压： | 9 V ~ 16 V |
| 降压： | 无 |
| 升压： | 无 |
| 回扫： | 无 |
| 反相： | 无 |
| 倍增器： | 无 |
| 除法器： | 无 |
| Cuk： | 无 |
| 隔离： | 是 |
| 工作温度： | -40°C ~ 105°C |
| 封装/外壳： | 20-SSOP（0.154"，3.90mm 宽） |
| 包装： | 管件 |
ISL6726
V pk =0.8UV+0.8
1.6UV/(C TC *R TC )
UV
DCLIM
0.8V
T 1
T 2
Intrinsic
Maximum D
T 1 =1/2C TC *R TC
T 2 =1/8C TC *R TC
Maximum D
Set by DCLIM
T DC = V DC /V pk *T 1
CS
FIGURE 15. MAXIMUM DUTY CYCLE CLAMP USING DCLIM
Synchronization
ISL6726 provides a single I/O pin synchronization function that
allows synchronization to an external clock or to self-synchronize
to another unit at ~180 degrees out-of-phase for interleaved
minimized. In most cases an external clock is used to
synchronize more than two units.
applications. When using an external clock, the clock pulse width
must be a minimum of 100ns. The clock frequency must be
higher than the free running frequency of the oscillator.
Multiple units may be synchronized together simply by
1 SYNC
2
3 ISL6726
4
20
19
18
17
1 SYNC
2
3 ISL6726
4
20
19
18
17
connecting the SYNC pins together as shown in Figure 16. In this
configuration all of the devices will synchronize out-of-phase with
the master. The master is usually the unit with the fastest free-
running oscillator, but may not be due to intentional hysteresis
within the arbitration circuitry. Synchronization occurs on the
leading edge of the SYNC signal. However, no unit will accept a
SYNC pulse while its oscillator ramp voltage is less than 3/8 of
5
CT1 6 CT
7
8
9
10
GND 16
OUTM 15 OUTM1
14
13
12
11
5
CT2 6 CT
7
8
9
10
GND 16
OUTM 15 OUTM2
14
13
12
11
the timing capacitor voltage peak voltage. This prevents short
cycling of the period.
If the SYNC pins of multiple devices are connected together, the
first SYNC signal that asserts will reset the oscillator RAMP of all
other devices. Further arbitration may occur if there is a higher
frequency unit present. All slave controllers will operate out-of-
phase with the master. Multiple devices may be synchronized in
this fashion, but the number will depend on the distance and
capacitance of the SYNC signal path. Care should be taken to
ensure the ground potential difference between devices is
17
OUTM1
OUTM2
CT1
CT2
FIGURE 16. SYNCHRONIZING TWO UNITS
FN7654.0
January 31, 2011
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PDF描述 |
|---|---|
| RGM08DTAT | CONN EDGECARD 16POS R/A .156 SLD |
| 0819-94K | COIL RF 820UH MOLDED UNSHIELDED |
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| VI-J5D-EY | CONVERTER MOD DC/DC 85V 50W |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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