参数资料
型号: ISL8126IRZ-TK
厂商: Intersil
文件页数: 11/39页
文件大小: 0K
描述: IC REG CTRLR BUCK PWM VM 32-QFN
标准包装: 1,000
PWM 型: 电压模式
输出数: 2
频率 - 最大: 1.5MHz
占空比: 90%
电源电压: 3 V ~ 5.6 V
降压:
升压:
回扫:
反相:
倍增器:
除法器:
Cuk:
隔离:
工作温度: -40°C ~ 85°C
封装/外壳: 32-VFQFN 裸露焊盘
包装: 带卷 (TR)
ISL8126
Typical Application Circuits (Continued)
Double Data Rate I or II
+3.3 TO +26.5V
VIN
C F2
R CC
VCC
C F1
PVCC
BOOT1
C HFIN
C BIN
C F3
VIN
UGATE1
PHASE1
Q1
C BOOT1
L OUT1
2.5V (DDR I)
1.8V (DDR II)
V DDQ
R FS
FSYNC
LGATE1
ISEN1A
ISEN1B
2k Ω
Q2
R ISEN1
C OUT1
10 Ω
10 Ω
ISL8126
COMP1 Z
COMP1
FB1
Z FB1
VMON1
V DDQ
VSEN1+
R FB1
V SENSE1+
VSEN1-
R OS1
C SEN1
V SENSE1-
R*(VTT/0.6-1)
(Notes 4, 5)
CLKOUT/REFIN
V DDQ Or VIN
R
1nF
BOOT2
(Or tie REFIN pin to VMON1 pin)
UGATE2
PHASE2
LGATE2
Q3
Q4
C BOOT2
L OUT2
1.25V (DDR I)
0.9V (DDR II)
V TT
( V DDQ /2)
C OUT2
2k Ω
ISEN2A
ISEN2B
10 Ω
PGOOD
COMP2 Z
FB2
COMP1
R ISEN2
10 Ω
Z FB1
VMON2
R SET
ISET
VSEN2+
R FB2
V SENSE2+
ISHARE
GND
VSEN2-
R OS2
C SEN2
V SENSE2-
NOTES:
4. Setting the upper resistor to be a little higher than R*(VDDQ/0.7 - 1) will set the final REFIN voltage (stead state voltage after soft-start)
derived from the VDDQ to be a little higher than internal 0.6V reference. In this way, the VTT final voltage will use the internal 0.6V
reference after soft-start. The other way is to add more delay at EN/VFF1 pin to have Channel 2 tracking VDDQ (check the “DDR and
Dual Mode Operation” on page 36 for more details).
5. Another way to set REFIN voltage is to connect VMON1 directly to the REFIN pin.
11
FN7892.1
August 16, 2012
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