参数资料
| 型号： | ISL8500IRZ-T |
| 厂商： | Intersil |
| 文件页数： | 8/15页 |
| 文件大小： | 0K |
| 描述： | IC REG BUCK ADJ 2A 12DFN |
| 产品培训模块： | Solutions for Industrial Control Applications |
| 标准包装： | 6,000 |
| 类型： | 降压（降压） |
| 输出类型： | 可调式 |
| 输出数： | 1 |
| 输出电压： | 0.6 V ~ 19 V |
| 输入电压： | 4.5 V ~ 25 V |
| PWM 型： | 电压模式 |
| 频率 - 开关： | 500kHz |
| 电流 - 输出： | 2A |
| 同步整流器： | 无 |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 12-VFDFN 裸露焊盘 |
| 包装： | 带卷 (TR) |
| 供应商设备封装： | 12-DFN（4x3） |
ISL8500
Typical Performance Curves
1.814
Unless otherwise noted, operating conditions are: T A = +25°C, V IN = 12V, EN = VDD, L = 10μH,
C OUT = 100μF, C 2 = 2x22μF, I OUT = 0A to 2A. See “The input supply for the PWM regulator
power stage and the source for the internal linear regulator that provides bias for the IC. Place a
ceramic capacitor from VIN to GND, close to the IC for decoupling (typical 10μF).” on page 6 .
(Continued)
2.506
1.813
1.812
12V IN
25V IN
2.505
2.504
25V IN
1.811
2.503
1.810
1.809
2.502
2.501
12V IN
1.808
5V IN
2.500
1.807
2.499
5V IN
1.806
0.0
0.5
1.0
1.5
2.0
2.498
0.0
0.5
1.0
1.5
2.0
OUTPUT LOAD (A)
FIGURE 8. V OUT REGULATION vs LOAD, 1.8V OUT
3.330
OUTPUT LOAD (A)
FIGURE 9. V OUT REGULATION vs LOAD, 2.5V OUT
4.99
3.328
3.326
12V IN
25V IN
4.98
4.97
25V IN
3.324
3.322
4.96
4.95
3.320
3.318
3.316
7V IN
4.94
4.93
4.92
7V IN
12V IN
3.314
0.0
0.5
1.0
1.5
2.0
4.91
0.0
0.5
1.0
1.5
2.0
OUTPUT LOAD (A)
FIGURE 10. V OUT REGULATION vs LOAD, 3.3V OUT
OUTPUT LOAD (A)
FIGURE 11. V OUT REGULATION vs LOAD, 5V OUT
PHASE 10V/DIV
PHASE 5V/DIV
VOUT RIPPLE
20mV/DIV
IL 0.5A/DIV
FIGURE 12. STEADY STATE OPERATION AT NO LOAD
(5μs/DIV)
8
VOUT RIPPLE
20mV/DIV
IL 1A/DIV
FIGURE 13. STEADY STATE OPERATION AT FULL LOAD
(1μs/DIV)
FN6611.0
December 10, 2007
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