参数资料
| 型号： | ISL8502IRZ |
| 厂商： | Intersil |
| 文件页数： | 10/19页 |
| 文件大小： | 0K |
| 描述： | IC REG BUCK SYNC ADJ 2.5A 24QFN |
| 标准包装： | 75 |
| 类型： | 降压（降压） |
| 输出类型： | 可调式 |
| 输出数： | 1 |
| 输出电压： | 0.6 V ~ 14 V |
| 输入电压： | 5V，5.5 V ~ 14 V |
| PWM 型： | 电压模式 |
| 频率 - 开关： | 500kHz ~ 1.2MHz |
| 电流 - 输出： | 2.5A |
| 同步整流器： | 是 |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 24-VFQFN 裸露焊盘 |
| 包装： | 管件 |
| 供应商设备封装： | 24-QFN（4x4） |
ISL8502
Typical Performance Curves
5.2
V IN = 12V, V OUT = 2.5V, I O = 2A, fs = 500kHz, L = 4.7μH, C IN = 20μF, C OUT = 100μF + 22μF,
T A = +25° C, unless otherwise noted. (Continued)
5.5
5.1
5.4
5.3
NO LOAD
5.0
4.9
5.2
5.1
5.0
4.8
4.7
4.6
4.9
4.8
4.7
4.6
1 00mA LOAD
4.5
0
50
100
150
200
250
300
4.5
3
4
5
6
7
8
9 10
11
12
13
14 15
I V CC (mA)
FIGURE 19. V CC LOAD REGULATION
V IN (V)
FIGURE 20. VCC REGULATION vs V IN
PHASE1
5V/DIV
0.5μs
PHASE1
5V/DIV
PHASE2
5V/DIV
IL1
VOUT1 RIPPLE
20mV/DIV
V OUT1 RIPPLE
20mV/DIV
V OUT2 RIPPLE
20mV/DIV
0.5A/DIV
SYNCH1
2V/DIV
FIGURE 21. MASTER TO SLAVE OPERATION
PHASE1
5V/DIV
VOUT1 RIPPLE
20mV/DIV
FIGURE 22. MASTER OPERATION AT NO LOAD
PHASE1
10V/DIV
VOUT1 RIPPLE
20mV/DIV
IL1
1A/DIV
IL1
1A/DIV
SYNCH1
5V/DIV
FIGURE 23. MASTER OPERATION WITH FULL LOAD
10
SYNCH1
5V/DIV
FIGURE 24. MASTER OPERATION WITH NEGATIVE LOAD
FN6389.2
June 29, 2010
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PDF描述 |
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