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参数资料
| 型号： | KMC8113TMP3600V |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 29/44页 |
| 文件大小： | 0K |
| 描述： | IC DSP 300/400MHZ 431FCPGA |
| 标准包装： | 2 |
| 系列： | StarCore |
| 类型： | SC140 内核 |
| 接口： | 以太网，I²C，TDM，UART |
| 时钟速率： | 300MHz |
| 非易失内存： | 外部 |
| 芯片上RAM： | 1.436MB |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 1.10V |
| 工作温度： | -40°C ~ 105°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 431-BFBGA，FCBGA |
| 供应商设备封装： | 431-FCPBGA（20x20） |
| 包装： | 托盘 |
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MSC8113 Tri-Core Digital Signal Processor Data Sheet, Rev. 1
Freescale Semiconductor
35
2.5.10.4
SMII Mode
2.5.11
GPIO Timing
Table 27. SMII Mode Signal Timing
No.
Characteristics
Min
Max
Unit
808
ETHSYNC_IN, ETHRXD to ETHCLOCK rising edge set-up time
1.0
—
ns
809
ETHCLOCK rising edge to ETHSYNC_IN, ETHRXD hold time
1.0
—
ns
810
ETHCLOCK rising edge to ETHSYNC, ETHTXD output delay
1.51
6.02
ns
Notes:
1.
Measured using a 5 pF load.
2.
Measured using a 15 pF load.
Figure 26. SMII Mode Signal Timing
Table 28. GPIO Timing
No.
Characteristics
Ref = CLKIN
Unit
Min
Max
601
REFCLK edge to GPIO out valid (GPIO out delay time)
—
6.1
ns
602
REFCLK edge to GPIO out not valid (GPIO out hold time)
1.1
—
ns
603
REFCLK edge to high impedance on GPIO out
—
5.4
ns
604
GPIO in valid to REFCLK edge (GPIO in set-up time)
3.5
—
ns
605
REFCLK edge to GPIO in not valid (GPIO in hold time)
0.5
—
ns
Figure 27. GPIO Timing
Valid
ETHCLOCK
ETHSYNC_IN
ETHRXD
ETHSYNC
ETHTXD
Valid
810
809
808
REFCLK
GPIO
(Output)
GPIO
(Input)
Valid
603
High Impedance
604
605
602
601
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