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参数资料
| 型号： | KMC8144SVT1000B |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 47/80页 |
| 文件大小： | 0K |
| 描述： | IC DSP 783FCPBGA |
| 标准包装： | 2 |
| 系列： | StarCore |
| 类型： | SC3400 内核 |
| 接口： | EBI/EMI，以太网，I²C，PCI，Serial RapidIO，SPI，TDM，UART，UTOPIA |
| 时钟速率： | 1.0GHz |
| 非易失内存： | ROM（96 kB） |
| 芯片上RAM： | 10.5MB |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 1.00V |
| 工作温度： | 0°C ~ 105°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 783-BBGA，FCBGA |
| 供应商设备封装： | 783-FCPBGA（29x29） |
| 包装： | 托盘 |
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Electrical Characteristics
2.6.5.5
Receiver Specifications
LP-Serial receiver electrical and timing specifications are stated in the text and tables of this section. Receiver input impedance
shall result in a differential return loss better that 10 dB and a common mode return loss better than 6 dB from 100 MHz to 0.8
× baud frequency. This includes contributions from internal circuitry, the package, and any external components related to the
receiver. AC coupling components are included in this requirement. The reference impedance for return loss measurements is
100 Ω resistive for differential return loss and 25 Ω resistive for common mode.
Table 32. Receiver AC Timing Specifications—1.25 GBaud
Range
Characteristic
Symbol
Min
Max
Unit
Notes
Differential Input Voltage
Deterministic Jitter Tolerance
Combined Deterministic and Random
V IN
J D
J DR
200
0.37
0.55
1600
mV PP
UI PP
UI PP
Measured at receiver
Measured at receiver
Measured at receiver
Jitter Tolerance
Total Jitter Tolerance
J T
0.65
UI PP
Measured at receiver. Total jitter is composed of
three components, deterministic jitter, random jitter
and single frequency sinusoidal jitter. The sinusoidal
jitter may have any amplitude and frequency in the
unshaded region of Figure 13 . The sinusoidal jitter
component is included to ensure margin for low
frequency jitter, wander, noise, crosstalk and other
variable system effects.
Multiple Input Skew
S MI
24
ns
Skew at the receiver input between lanes of a
multilane link
Bit Error Rate
BER
10 –12
Unit Interval
UI
800
800
ps
± 100 ppm
Table 33. Receiver AC Timing Specifications—2.5 GBaud
Range
Characteristic
Symbol
Min
Max
Unit
Notes
Differential Input Voltage
Deterministic Jitter Tolerance
Combined Deterministic and Random
V IN
J D
J DR
200
0.37
0.55
1600
mV PP
UI PP
UI PP
Measured at receiver
Measured at receiver
Measured at receiver
Jitter Tolerance
Total Jitter Tolerance
J T
0.65
UI PP
Measured at receiver. Total jitter is composed of
three components, deterministic jitter, random jitter
and single frequency sinusoidal jitter. The sinusoidal
jitter may have any amplitude and frequency in the
unshaded region of Figure 13 . The sinusoidal jitter
component is included to ensure margin for low
frequency jitter, wander, noise, crosstalk and other
variable system effects.
Multiple Input Skew
S MI
24
ns
Skew at the receiver input between lanes of a
multilane link
Bit Error Rate
BER
10 –12
Unit Interval
UI
400
400
ps
± 100 ppm
MSC8144 Quad Core Digital Signal Processor Data Sheet, Rev. 16
Freescale Semiconductor
47
相关PDF资料 |
PDF描述 |
|---|---|
| KMC8144VT800B | IC DSP 783FCPBGA |
| TAJC686K010ANJ | CAP TANT 68UF 10V 10% 2312 |
| KMC8144VT800A | IC DSP 783FCPBGA |
| KMC8144VT1000B | IC DSP 783FCPBGA |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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| KMC8144SVT800B | 功能描述:IC DSP 783FCPBGA RoHS:是 类别:集成电路 (IC) >> 嵌入式 - DSP（数字式信号处理器） 系列:StarCore 标准包装:40 系列:TMS320DM64x, DaVinci™ 类型:定点 接口:I²C，McASP，McBSP 时钟速率:400MHz 非易失内存:外部 芯片上RAM:160kB 电压 - 输入/输出:3.30V 电压 - 核心:1.20V 工作温度:0°C ~ 90°C 安装类型:表面贴装 封装/外壳:548-BBGA，FCBGA 供应商设备封装:548-FCBGA（27x27） 包装:托盘 配用:TMDSDMK642-0E-ND - DEVELPER KIT W/NTSC CAMERA296-23038-ND - DSP STARTER KIT FOR TMS320C6416296-23059-ND - FLASHBURN PORTING KIT296-23058-ND - EVAL MODULE FOR DM642TMDSDMK642-ND - DEVELOPER KIT W/NTSC CAMERA |
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