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参数资料
型号： KMSC7119VM1200
厂商： Freescale Semiconductor
文件页数： 31/60页
文件大小： 0K
描述： DSP 16BIT W/DDR CTRLR 400-MAPBGA
标准包装： 2
系列： StarCore
类型： 定点
接口： 主机接口，I²C，UART
时钟速率： 300MHz
非易失内存： ROM（8 kB）
芯片上RAM： 464kB
电压 - 输入/输出： 3.30V
电压 - 核心： 1.20V
工作温度： -40°C ~ 105°C
安装类型： 表面贴装
封装/外壳： 400-LFBGA
供应商设备封装： 400-MAPBGA（17x17）
包装： 托盘
MSC7119 Data Sheet, Rev. 8
Freescale Semiconductor
37
2.5.9
UART Timing
2.5.10
EE Timing
Figure 24 shows the signal behavior of the EE pin.
Table 27. UART Timing
No.
Characteristics
Expression
Min
Max
Unit
—
Internal bus clock (APBCLK)
FCORE/2
—
150
MHz
—
Internal bus clock period (1/APBCLK)
TAPBCLK
6.67
—
ns
400
URXD and UTXD inputs high/low duration
16
× TAPBCLK
106.67
—
ns
401
URXD and UTXD inputs rise/fall time
—
5
ns
402
UTXD output rise/fall time
—
5
ns
Figure 21. UART Input Timing
Figure 22. UART Output Timing
Table 28. EE0 Timing
Number
Characteristics
Type
Min
65
EE0 input to the core
Asynchronous
4 core clock periods
66
EE0 output from the core
Synchronous to core clock
1 core clock period
Notes:
1.
The core clock is the SC1400 core clock. The ratio between the core clock and CLKOUT is configured during power-on-reset.
2.
Configure the direction of the EE pin in the EE_CTRL register (see the SC140/SC1400 Core Reference Manual for details.
3.
Refer to Table 1-11 on page 1-16 for details on EE pin functionality.
Figure 23. EE Pin Timing
UTXD, URXD
400
inputs
400
401
UTXD Output
402
EE0 In
65
EE0 Out
66
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PDF描述
KMSC7118VF1200 DSP 16BIT W/DDR CTRLR 400-MAPBGA
AIML-0805-R68K-T INDUCTOR MULTILAYER 0.68UH 0805
MMBD1201 DIODE 100V 200MA SOT23
KMSC7116VM1000 DSP 16BIT W/DDR CTRLR 400-MAPBGA
VE-23N-EU CONVERTER MOD DC/DC 18.5V 200W
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参数描述
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