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参数资料
型号： KSZ8863RLLI
厂商： Micrel Inc
文件页数： 99/106页
文件大小： 0K
描述： IC ETHERNET SWITCH 3PORT 48-LQFP
标准包装： 250
控制器类型： 以太网开关控制器
接口： MII
电源电压： 1.8V，2.5V，3.3V
工作温度： -40°C ~ 85°C
安装类型： 表面贴装
封装/外壳： 48-LQFP
供应商设备封装： 48-LQFP（7x7）
包装： 托盘
配用： 576-3868-ND - BOARD EVALUATION FOR KSZ8863RLL
其它名称： 576-3752
PIC16C72 Series
1998 Microchip Technology Inc.
Preliminary
DS39016A-page 91
TABLE 13-8
SPI SLAVE MODE REQUIREMENTS (CKE=0) - PIC16C72
TABLE 13-9
SPI MODE REQUIREMENTS - PIC16CR72
Param
No.
Sym
Characteristic
Min
Typ
Max
Units
Conditions
70
TssL2scH,
TssL2scL
SS
↓ to SCK↓ or SCK↑ input
TCY
—
ns
71
TscH
SCK input high time (slave mode)
TCY + 20
—
ns
72
TscL
SCK input low time (slave mode)
TCY + 20
—
ns
73
TdiV2scH,
TdiV2scL
Setup time of SDI data input to SCK edge
50
—
ns
74
TscH2diL,
TscL2diL
Hold time of SDI data input to SCK edge
50
—
ns
75
TdoR
SDO data output rise time
—
10
25
ns
76
TdoF
SDO data output fall time
—
10
25
ns
77
TssH2doZ
SS
↑ to SDO output hi-impedance
10
—
50
ns
78
TscR
SCK output rise time (master mode)
—
10
25
ns
79
TscF
SCK output fall time (master mode)
—
10
25
ns
80
TscH2doV,
TscL2doV
SDO data output valid after SCK edge
—
50
ns
Data in "Typ" column is at 5V, 25C unless otherwise stated. These parameters are for design guidance only and are not
tested.
Parameter
No.
Sym
Characteristic
Min
Typ
Max
Units
Conditions
70*
TssL2scH,
TssL2scL
SS
↓ to SCK↓ or SCK↑ input
TCY
—
ns
71*
TscH
SCK input high time (slave mode)
TCY + 20
—
ns
72*
TscL
SCK input low time (slave mode)
TCY + 20
—
ns
73*
TdiV2scH,
TdiV2scL
Setup time of SDI data input to SCK
edge
100
—
ns
74*
TscH2diL,
TscL2diL
Hold time of SDI data input to SCK
edge
100
—
ns
75*
TdoR
SDO data output rise time
—
10
25
ns
76*
TdoF
SDO data output fall time
—
10
25
ns
77*
TssH2doZ
SS
↑ to SDO output hi-impedance
10
—
50
ns
78*
TscR
SCK output rise time (master mode)
—
10
25
ns
79*
TscF
SCK output fall time (master mode)
—
10
25
ns
80*
TscH2doV,
TscL2doV
SDO data output valid after SCK
edge
—
50
ns
81*
TdoV2scH,
TdoV2scL
SDO data output setup to SCK
edge
TCY
—
ns
82*
TssL2doV
SDO data output valid after SS
↓
edge
—
50
ns
83*
TscH2ssH,
TscL2ssH
SS
↑ after SCK edge
1.5TCY + 40
—
ns
*
These parameters are characterized but not tested.
Data in "Typ" column is at 5V, 25C unless otherwise stated. These parameters are for design guidance only and are not
tested.
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