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参数资料
| 型号： | KSZ8873FLL |
| 厂商： | Micrel Inc |
| 文件页数： | 69/115页 |
| 文件大小： | 0K |
| 描述： | IC ETHERNET SW 3PORT 64LQFP |
| 产品培训模块： | KSZ8873 Ethernet Switches |
| 特色产品： | KSZ8873 Ethernet Switch Controller |
| 标准包装： | 160 |
| 控制器类型： | 以太网开关控制器 |
| 接口： | MII |
| 电源电压： | 1.8V，2.5V，3.3V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-LQFP |
| 供应商设备封装： | 64-LQFP（10x10） |
| 包装： | 托盘 |
| 其它名称： | 576-3631 KSZ8873FLL-ND |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页当前第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页
Micrel, Inc.
KSZ8873MLL/FLL/RLL
September 20, 2013
57
Revision 1.6
Register 6 (0x06): Global Control 4
Bit
Name
R/W
Description
Default
7
Reserved
RO
Reserved
Do not change the default values.
0
6
Port 3 Duplex Mode
Selection
R/W
=1, Enable Port 3 MII to half-duplex mode.
=0, Enable Port 3 MII to full-duplex mode.
0
Pin P1LED0 strap option.
Pull-up(1): Half -duplex mode
Pull-down(0): Full-duplex mode
(default)
Note: P1LED0 has internal pull-
down.
5
Port 3 Flow Control
Enable
R/W
=1, Enable full duplex flow control on Switch port 3 MII
interface.
=0, Disable full duplex flow control on Switch port 3 MII
interface.
1
Pin P1LED1 strap option.
Pull- up(1): Enable flow control
Pull-down(0): Disable flow control
Note: P1LED1 has internal pull-up.
4
Port 3 Speed
selection
R/W
=1, The port 3 MII switch interface is in 10Mbps mode
=0, The port 3 MII switch interface is in 100Mbps mode
0
Pin P3SPD strap option.
Pull-up(1): Enable 10Mbps
Pull-down(0): Enable 100Mbps
(default)
Note: P3SPD has internal pull-
down.
3
Null VID
Replacement
R/W
=1, Will replace NULL VID with port VID (12 bits)
=0, No replacement for NULL VID
0
2-0
Broadcast Storm
Protection Rate
(1)
Bit [10:8]
R/W
This register along with the next register determines
how many “64 byte blocks” of packet data are allowed
on an input port in a preset period. The period is 67ms
for 100BT or 500ms for 10BT. The default is 1%.
000
Register 7 (0x07): Global Control 5
Bit
Name
R/W
Description
Default
7-0
Broadcast Storm
Protection Rate
Bit [7:0]
R/W
This register along with the previous register determines how many “64 byte
blocks” of packet data are allowed on an input port in a preset period. The period
is 67ms for 100BT or 500ms for 10BT. The default is 1%.
0x63
Note:
3.
100BT Rate: 148,800 frames/sec * 67 ms/interval * 1% = 99 frames/interval (approx.) = 0x63.
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