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参数资料
| 型号： | KSZ8873FLL |
| 厂商： | Micrel Inc |
| 文件页数： | 84/115页 |
| 文件大小： | 0K |
| 描述： | IC ETHERNET SW 3PORT 64LQFP |
| 产品培训模块： | KSZ8873 Ethernet Switches |
| 特色产品： | KSZ8873 Ethernet Switch Controller |
| 标准包装： | 160 |
| 控制器类型： | 以太网开关控制器 |
| 接口： | MII |
| 电源电压： | 1.8V，2.5V，3.3V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-LQFP |
| 供应商设备封装： | 64-LQFP（10x10） |
| 包装： | 托盘 |
| 其它名称： | 576-3631 KSZ8873FLL-ND |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页当前第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页
Micrel, Inc.
KSZ8873MLL/FLL/RLL
September 20, 2013
70
Revision 1.6
Register 29 (0x1D): Port 1 Control 13
Register 45 (0x2D): Port 2 Control 13
Register 61 (0x3D): Reserved, Not Applied to Port 3
Bit
Name
R/W
Description
Default
7
LED Off
R/W
=1, Turn off all port’s LEDs (LEDx_1, LEDx_0, where “x” is
the port number). These pins will be driven high if this bit is
set to one.
=0, Normal operation
0
6
Txdis
R/W
=1, Disable the port’s transmitter
=0, Normal operation
0
5
Restart AN
R/W
=1, Restart auto-negotiation
=0, Normal operation
0
4
Disable Far-
end Fault
R/W
=1, Disable far-end fault detection and pattern transmission.
=0, Enable far-end fault detection and pattern transmission
0
3
Power Down
R/W
=1, Power down
=0, Normal operation
0
2
Disable Auto
MDI/MDI-X
R/W
=1, Disable auto MDI/MDI-X function
=0, Enable auto MDI/MDI-X function
0
1
Force MDI
R/W
If auto MDI/MDI-X is disabled,
=1, Force PHY into MDI mode (transmit on RXP/RXM pins)
=0, Force PHY into MDI-X mode (transmit on TXP/TXM
pins)
0
Loopback
R/W
=1, Perform loopback, as indicated:
Port 1 Loopback (reg. 29, bit 0 = ‘1’)
Start: RXP2/RXM2 (port 2)
Loopback: PMD/PMA of port 1’s PHY
End: TXP2/TXM2 (port 2)
Port 2 Loopback (reg. 45, bit 0 = ‘1’)
Start: RXP1/RXM1 (port 1)
Loopback: PMD/PMA of port 2’s PHY
End: TXP1/TXM1 (port 1)
=0, Normal operation
0
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