- 您现在的位置：买卖IC网 > PDF目录22084 > LAMXO256C-3TN100E (Lattice Semiconductor Corporation)IC FPGA AUTO 256LUTS 100-TQFP PDF资料下载
参数资料
| 型号： | LAMXO256C-3TN100E |
| 厂商： | Lattice Semiconductor Corporation |
| 文件页数： | 37/77页 |
| 文件大小： | 0K |
| 描述： | IC FPGA AUTO 256LUTS 100-TQFP |
| 标准包装： | 90 |
| 系列： | LA-MachXO |
| 可编程类型： | 系统内可编程 |
| 最大延迟时间 tpd(1)： | 4.9ns |
| 电压电源 - 内部： | 1.71 V ~ 3.465 V |
| 宏单元数： | 128 |
| 输入/输出数： | 78 |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 100-LQFP |
| 供应商设备封装： | 100-TQFP（14x14） |
| 包装： | 托盘 |
| 其它名称： | 220-1637 LAMXO256C-3TN100E-ND |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页当前第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页
3-16
DC and Switching Characteristics
Lattice Semiconductor
LA-MachXO Automotive Family Data Sheet
sysCLOCK PLL Timing
Over Recommended Operating Conditions
LA-MachXO “C” Sleep Mode Timing
Parameter
Descriptions
Conditions
Min.
Max.
Units
fIN
Input Clock Frequency (CLKI, CLKFB)
25
420
MHz
fOUT
Output Clock Frequency (CLKOP, CLKOS)
25
420
MHz
fOUT2
K-Divider Output Frequency (CLKOK)
0.195
210
MHz
fVCO
PLL VCO Frequency
420
840
MHz
fPFD
Phase Detector Input Frequency
25
—
MHz
AC Characteristics
tDT
Output Clock Duty Cycle
Default duty cycle selected
3
45
55
%
tPH
4
Output Phase Accuracy
—
0.05
UI
tOPJIT
1
Output Clock Period Jitter
Fout ≥ 100MHz
—
+/-120
ps
Fout < 100MHz
—
0.02
UIPP
tSK
Input Clock to Output Clock Skew
Divider ratio = integer
—
+/-200
ps
tW
Output Clock Pulse Width
At 90% or 10%
3
1—
ns
tLOCK
2
PLL Lock-in Time
—
150
s
tPA
Programmable Delay Unit
100
450
ps
tIPJIT
Input Clock Period Jitter
—
+/-200
ps
tFBKDLY
External Feedback Delay
—
10
ns
tHI
Input Clock High Time
90% to 90%
0.5
—
ns
tLO
Input Clock Low Time
10% to 10%
0.5
—
ns
tRST
RST Pulse Width
10
—
ns
1. Jitter sample is taken over 10,000 samples of the primary PLL output with a clean reference clock.
2. Output clock is valid after tLOCK for PLL reset and dynamic delay adjustment.
3. Using LVDS output buffers.
4. CLKOS as compared to CLKOP output.
Rev. A 0.19
Symbol
Parameter
Device
Min.
Typ.
Max
Units
tPWRDN
SLEEPN Low to Power Down
All
—
400
ns
tPWRUP
SLEEPN High to Power Up
LCMXO256
—
400
s
LCMXO640
—
600
s
tWSLEEPN
SLEEPN Pulse Width
All
400
—
ns
tWAWAKE
SLEEPN Pulse Rejection
All
—
100
ns
Rev. A 0.19
SLEEPN
tPWRUP
Power Down Mode
tPWRDN
tWSLEEPN or tWAWAKE
I/O
相关PDF资料 |
PDF描述 |
|---|---|
| 9230-44-RC | CHOKE RF MOLDED 10UH 10% FERRITE |
| TRMD337K006R0035 | CAP TANT 330UF 6.3V 10% 2917 |
| VE-B72-CY-F3 | CONVERTER MOD DC/DC 15V 50W |
| VE-2NV-EV-F3 | CONVERTER MOD DC/DC 5.8V 150W |
| ISL61853BCRZ-T | IC USB PWR CTRLR DUAL 10DFN |
相关代理商/技术参数 |
参数描述 |
|---|---|
| LAMXO256E | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:LA-MachXO Automotive Family Data Sheet |
| LAMXO256E-3TN100E | 功能描述:CPLD - 复杂可编程逻辑器件 Auto Grade (AEC-Q100 ) MachXO256E RoHS:否 制造商:Lattice 系列: 存储类型:EEPROM 大电池数量:128 最大工作频率:333 MHz 延迟时间:2.7 ns 可编程输入/输出端数量:64 工作电源电压:3.3 V 最大工作温度:+ 90 C 最小工作温度:0 C 封装 / 箱体:TQFP-100 |
| LAMXO256LUTSC-3FTN256E | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:LA-MachXO Automotive Family Data Sheet |
| LAMXO256LUTSC-3FTN324E | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:LA-MachXO Automotive Family Data Sheet |
| LAMXO256LUTSC-3TN100E | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:LA-MachXO Automotive Family Data Sheet |
发布紧急采购，3分钟左右您将得到回复。