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参数资料
| 型号： | LC5512MC-75Q208I |
| 厂商： | LATTICE SEMICONDUCTOR CORP |
| 元件分类： | PLD |
| 中文描述： | EE PLD, 9.5 ns, PQFP208 |
| 封装： | PLASTIC, QFP-208 |
| 文件页数： | 22/95页 |
| 文件大小： | 923K |
| 代理商： | LC5512MC-75Q208I |
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Lattice Semiconductor
ispXPLD 5000MX Family Data Sheet
29
ispXPLD 5000MX Family External Switching Characteristics
1, 2, 3
Over Recommended Operating Conditions
Parameter
Description
-4
-45
-5
-52
-75
Units
Min.
Max.
Min.
Max.
Min.
Max.
Min.
Max.
Min.
Max.
tPD
Data Propagation Delay,
5-PT Bypass
—4.0
—4.5
—5.0
—5.2
—7.5
ns
tPD_PTSA
Data propagation delay
—
4.8
—
5.7
—
6.0
—
6.5
—
9.5
ns
tS
MFB Register Setup Time
Before Clock, 5-PT Bypass
2.2
—
2.8
—
2.8
—
3.0
—
4.5
—
ns
tS_PTSA
MFB Register Setup Time
Before Clock
2.5
—
3.1
—
3.1
—
3.6
—
5.5
—
ns
tSIR
MFB Register Setup Time
Before Clock, Input Register
Path
1.0
—
1.0
—
1.0
—
0.5
—
1.7
—
ns
tH
MFB Register Hold Time
Before Clock, 5-PT Bypass
0.0
—
0.0
—
0.0
—
0.0
—
0.0
—
ns
tH_PTSA
MFB Register Hold Time
Before Clock
0.0
—
0.0
—
0.0
—
0.0
—
0.0
—
ns
tHIR
MFB Register Hold Time
Before Clock, Input Register
Path
0.5
—
0.5
—
0.5
—
1.0
—
1.3
—
ns
tCO
MFB Register Clock-to-Out-
put Delay
—2.8
—3.0
—3.2
—3.7
—5.0
ns
tR
External Reset Pin to Output
Delay
—4.0
—4.5
—5.0
—7.5
ns
tRW
Reset Pulse Duration
1.8
—
1.8
—
1.8
—
2.0
—
3.0
—
ns
tLPTOE/DIS
Input to Output Local Product
Term Output Enable/Disable
—6.0
—7.0
—7.5
—8.5
—
10.5
ns
tSPTOE/DIS
Input to Output Shared
Product Term Output Enable/
Disable
—6.0
—7.0
—7.5
—8.5
—
10.5
ns
tGOE/DIS
Global OE Input to Output
Enable/Disable
—4.5
—5.5
—6.5
—7.5
ns
tCW
Clock Width, High or Low
1.5
—
1.5
—
1.5
—
1.8
—
2.5
—
ns
tGW
Gate Width Low (for Low
Transparent) or High (for
High Transparent)
1.5
—
1.5
—
1.5
—
1.8
—
2.5
—
ns
tWIR
Input Register Clock Width,
High or Low
1.5
—
1.5
—
1.5
—
1.8
—
2.5
—
ns
tSKEW
Clock-to-Out Skew, Block
Level
—0.6
—1.0
ns
fMAX
4
Clock Frequency with
Internal Feedback
—
300
—
275
—
250
—
250
—
150
MHz
fMAX (Ext.)
Clock Frequency with
External Feedback,
1/ (tS + tCO)
—
200
—
171
—
166
—
149
—
105
MHz
fMAX (Tog.)
Clock Frequency Max.
Toggle
—
333
—
333
—
333
—
277
—
200
MHz
fMAX (CAMC)
5
Clock Frequency to CAM
(Configure Mode)
—
280
—
280
—
230
—
230
—
168
MHz
fMAX (CAM)
5
Clock Frequency to CAM
(Compare Mode)
—
150
—
150
—
150
—
135
—
90
MHz
相关PDF资料 |
PDF描述 |
|---|---|
| LC5512MC-75F256I | |
| LC5256MC-5F256I | |
| LC5512MB-45F484C | |
| LC5256MC-75F256I | |
| LC51024MC-52F672C | |
相关代理商/技术参数 |
参数描述 |
|---|---|
| LC5512MC-75Q256C | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:3.3V, 2.5V and 1.8V In-System Programmable eXpanded Programmable Logic Device XPLD⑩ Family |
| LC5512MC-75Q256I | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:3.3V, 2.5V and 1.8V In-System Programmable eXpanded Programmable Logic Device XPLD⑩ Family |
| LC5512MC-75Q484C | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:3.3V, 2.5V and 1.8V In-System Programmable eXpanded Programmable Logic Device XPLD⑩ Family |
| LC5512MC-75Q484I | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:3.3V, 2.5V and 1.8V In-System Programmable eXpanded Programmable Logic Device XPLD⑩ Family |
| LC5512MC-75Q672C | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:3.3V, 2.5V and 1.8V In-System Programmable eXpanded Programmable Logic Device XPLD⑩ Family |
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