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参数资料
| 型号： | M68HC05M68H |
| 厂商： | Motorola, Inc. |
| 英文描述： | HCMOS Microcontroller Unit |
| 中文描述： | HCMOS微控制器 |
| 文件页数： | 82/130页 |
| 文件大小： | 1541K |
| 代理商： | M68HC05M68H |
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Analog Subsystem
Advance Information
MC68HC705P6A
—
Rev. 2.0
82
Analog Subsystem
MOTOROLA
9.7 A/D Conversion Data Register (ADC)
This register contains the output of the A/D converter. See
Figure 9-2
.
9.8 A/D Subsystem Operation during Halt/Wait Modes
The A/D subsystem continues normal operation during wait and halt
modes. To decrease power consumption during wait or halt mode, the
ADON and ADRC bits in the A/D status and control register should be
cleared if the A/D subsystem is not being used.
9.9 A/D Subsystem Operation during Stop Mode
When stop mode is enabled, execution of the STOP instruction will
terminate all A/D subsystem functions. Any pending conversion is
aborted. When the oscillator resumes operation upon leaving stop
mode, a finite amount of time passes before the A/D subsystem
stabilizes sufficiently to provide conversions at its rated accuracy. The
delays built into the MC68HC705P6A when coming out of stop mode are
sufficient for this purpose. No explicit delays need to be added to the
application software.
Address: $001D
Bit 7
6
5
4
3
2
1
Bit 0
Read:
AD7
AD6
AD5
AD4
AD3
AD2
AD1
AD0
Write:
Reset:
Unaffected by reset
= Unimplemented
Figure 9-2. A/D Conversion Value Data Register (ADC)
相关PDF资料 |
PDF描述 |
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参数描述 |
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