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参数资料
| 型号： | M7010R-066ZA1T |
| 厂商： | 意法半导体 |
| 英文描述： | 16K x 68-bit Entry NETWORK SEARCH ENGINE |
| 中文描述： | 16K的× 68位进入网络搜索引擎 |
| 文件页数： | 51/67页 |
| 文件大小： | 449K |
| 代理商： | M7010R-066ZA1T |
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M7010R
Figure 37. LEARN Timing Diagram on Device Number 7 (TLSZ = 01)
Table 34. SRAM WRITE Cycle Latency from Second Cycle of LEARN Instruction
Number of Devices
Latency in CLK Cycles
1 (TLSZ = 00)
4
1-8 (TLSZ = 01)
5
1-31 (TLSZ = 10)
6
Cycle
1
Cycle
2
Cycle
3
Cycle
4
Cycle
5
Cycle
7
Cycle
6
Cycle
8
Cycle
10
Cycle
9
CLK2X
CMDV
CMD[1:0]
ALE_L, CE_L
WE_L
OE_L
SADR[21:0]
SSV
SSF
CMD[8:2]
PHS_L
AI07047
A
B
X
X
X
X
X
X
DQ
1
1
1
1
1
1
0
z
z
z
z
z
z
1
0
0
0
Learn1
Learn2
X
X
TLSZ = 01, LRAM = 1, LDEV = 1
Comp1
Comp2
1A 1B
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
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