参数资料
| 型号： | MAX1494CCJ+T |
| 厂商： | Maxim Integrated |
| 文件页数： | 3/34页 |
| 文件大小： | 0K |
| 描述： | IC ADC W/LCD DRIVER 32-TQFP |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 2,000 |
| 显示器类型： | LCD |
| 配置： | 7 段 + 2 个信号器 |
| 接口： | 串行 |
| 数字或字符： | A/D，4.5 位数字 |
| 电流 - 电源： | 960µA |
| 电源电压： | 2.7 V ~ 5.25 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 32-LQFP |
| 供应商设备封装： | 32-LQFP（7x7） |
| 包装： | 带卷 (TR) |
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3.5- and 4.5-Digit, Single-Chip ADCs
with LCD Drivers
ELECTRICAL CHARACTERISTICS (continued)
(V AVDD = V DVDD = 2.7V to 5.25V, V GND = 0V, V REF+ - V REF- = 2.048V (external reference). Internal clock mode, unless otherwise noted.
All specifications are at T A = T MIN to T MAX , unless otherwise noted. Typical values are at T A = +25°C, unless otherwise noted.)
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS
Internal clock mode, 50Hz and 60Hz ±2%
100
Normal-Mode 50Hz and 60Hz
Rejection (Simultaneously)
External clock mode, 50Hz and 60Hz ±2%,
f CLK = 4.915MHz
120
dB
Common-Mode 50Hz and 60Hz
Rejection (Simultaneously)
Common-Mode Rejection
Input Leakage Current
Input Capacitance
CMR
CMR
For 50Hz and 60Hz ±2%, R SOURCE < 10k ?
At DC
150
100
10
10
dB
dB
nA
pF
Dynamic Input Current
(Note 6)
-20
+20
nA
LOW-BATTERY VOLTAGE MONITOR (LOWBATT)
LOWBATT Trip Threshold
LOWBATT Leakage Current
Hysteresis
INTERNAL REFERENCE (INTRE F BIT = 1, REF- = GND, bypass REF+ to GND with a 4.7μF capacitor)
2.048
10
20
V
pA
mV
REF Output Voltage
V REF
V AVDD = 5V, T A = +25 ° C
2.007
2.048
2.089
V
REF Output Short-Circuit Current
1
mA
REF Output Temperature
Coefficient
Load Regulation
Line Regulation
Noise Voltage
TC VREF
V AVDD = 5V
I SOURCE = 0 to 300μA, I SINK = 0 to 30μA
0.1Hz to 10Hz
10Hz to 10kHz
40
6
50
25
400
ppm/ ° C
mV/μA
μV/V
μV P-P
EXTERNAL REFERENCE (INTRE F BIT = 0, bypass REF+ and REF- to GND with 0.1μF or larger capacitors)
REF Input Voltage
Absolute REF Input Voltage to
GND
Normal-Mode 50Hz and 60Hz
Rejection (Simultaneously)
Differential (V REF+ - V REF- )
Internal clock mode, 50Hz and 60Hz ±2%
External clock mode, 50Hz and 60Hz ±2%,
f CLK = 4.915MHz
-2.2
2.048
100
120
+2.2
V
V
dB
Common-Mode 50Hz and 60Hz
Rejection (Simultaneously)
Common-Mode Rejection
Input Leakage Current
Input Capacitance
CMR
CMR
For 50Hz and 60Hz ±2%, R SOURCE < 10k ?
At DC
150
100
10
10
dB
dB
nA
pF
Dynamic Input Current
(Note 6)
-20
+20
nA
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