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参数资料
| 型号： | MB91F465PAPMC-GSE2 |
| 厂商： | FUJITSU LTD |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | RISC MICROCONTROLLER, PQFP176 |
| 封装： | 24 X 24 MM, 0.50 MM PITCH, LEAD FREE, PLASTIC, LQFP-176 |
| 文件页数： | 141/200页 |
| 文件大小： | 6566K |
| 代理商： | MB91F465PAPMC-GSE2 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页当前第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页
MB91460P Series
DS07-16615-2E
45
4.1.
A/D Control Status Registers (ADCS2, ADCS1, ADCS0)
The A/D control status registers control and show the status of A/D converter. Do not overwrite ADCS0 register
during A/D converting.
ADCS2 : Access: Byte
[bits 15:12] BUSY, INT, INTE, PAUS
These bits are a mirror of the corresponding bits in ADCS1, intended to quickly read out all status and interrupt
information using only one register access. To write the bits, access them via ADCS1.
[bits 11:10] -
These bits do not exist. Read operation returns 0.
[bit 9] INT2 (End of Scan Flag)
The End of Scan flag is set when conversion data of the last channel is stored in ADCR, whereas the last channel
is defined by ADECH register setting.
If bit 8 (INTE2) is "1" when this bit is set, and the ADC runs in continuous conversion mode, an End of Scan
interrupt request is generated or, if activation of DMA is enabled, DMA is activated.
Only clear this bit by writing "0" when A/D conversion is halted.
Initialized to "0" by a reset.
If DMA is used, this bit is cleared at the end of DMA transfer.
Read-modify-write operations read this bit as “1”.
[bit 8] INTE2 (Enable End of Scan Interrupt)
INTE2 enables the End of Scan interrupt in continuous conversion mode. In the other conversion modi, this bit
has no effect.
Additionally, setting INTE2 changes the protect function of converted data (see description of ADCS1.PAUS).
15
14
13
12
11
10
9
8
Bit
BUSY
INT
INTE
PAUS
-
INT2
INTE2
00000000
Initial value
R
R0
R/W
Attribute
INTE2
Function
0 [initial]
Disable End of Scan interrupt,
ADC result protection protects the ADCR register data.
1
Enable End of Scan interrupt,
ADC result protection protects the ADCD0...ADCD31 register data
(in continuous conversion mode only)
相关PDF资料 |
PDF描述 |
|---|---|
| MB95F353LPF-G-SNE2 | MICROCONTROLLER, PDSO24 |
| MPC8560CVT667JC | 32-BIT, 667 MHz, RISC PROCESSOR, PBGA783 |
| M926-02I622.0800 | 622.08 MHz, OTHER CLOCK GENERATOR, CQCC36 |
| M928-02-700.0000 | 700 MHz, OTHER CLOCK GENERATOR, CQCC36 |
| MK1411SLF | 35.46896 MHz, VIDEO CLOCK GENERATOR, PDSO8 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| MB91F465X | 制造商:FUJITSU 制造商全称:Fujitsu Component Limited. 功能描述:The Ultimate Automotive Network |
| MB91F465XAPMC-ESE2 | 制造商:FUJITSU 功能描述: |
| MB91F465XAPMC-GE1 | 制造商:FUJITSU 功能描述: |
| MB91F466BA | 制造商:FUJITSU 制造商全称:Fujitsu Component Limited. 功能描述:32-bit Microcontroller |
| MB91F466HAPMC-GSE2 | 制造商:FUJITSU 功能描述: |
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