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参数资料
| 型号： | MC68HC05F32CFU |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 1.789 MHz, MICROCONTROLLER, PQFP80 |
| 封装： | QFP-80 |
| 文件页数： | 146/198页 |
| 文件大小： | 2335K |
| 代理商： | MC68HC05F32CFU |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页当前第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页
MC68HC05F32
MOTOROLA
4-7
PARALLEL INPUT/OUTPUT PORTS
4
4.8
Port registers
The following sections explain in detail the individual bits in the data and control registers
associated with the ports.
4.8.1
Port data registers (Ports A, B, C, D, E, F, G, H, I and J)
Each bit of port A – port E can be congured as input or output via the corresponding data
direction bit in the port data direction register (DDRx).
Reset does not affect the state of the port A – port G data registers. However, port H, port I and
port J data registers are reset to 0.
4.8.2
Data direction registers (DDRA, DDRB, DDRC, DDRD and
DDRE)
Writing a ‘1’ to any bit congures the corresponding port pin as an output; conversely, writing any
bit to ‘0’ congures the corresponding port pin as an input.
Reset clears these registers, thus conguring all port pins as inputs.
Address
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
State
on reset
Port A data (PORTA)
$0000
PA7
PA6
PA5
PA4
PA3
PA2
PA1
PA0
undened
Port B data (PORTB)
$0001
PB7
PB6
PB5
PB4
PB3
PB2
PB1
PB0
undened
Port C data (PORTC)
$0002
PC7
PC6
PC5
PC4
PC3
PC2
PC1
PC0
undened
Port D data (PORTD)
$0003
PD7
PD6
PD5
PD4
PD3
PD2
PD1
PD0
undened
Port E data (PORTE)
$000A
PE7
PE6
PE5
PE4
PE3
PE2
PE1
PE0
undened
Port F data (PORTF)
$0010
PF7
PF6
PF5
PF4
PF3
PF2
PF1
PF0
undened
Port G data (PORTG)
$0012
PG7
PG6
PG5
PG4
PG3
PG2
PG1
PG0
undened
Port H data (PORTH)
$0014
PH7
PH6
PH5
PH4
PH3
PH2
PH1
PH0
0000 0000
Port I data (PORTI)
$0016
PI7
PI6
PI5
PI4
PI3
PI2
PI1
PI0
0000 0000
Port J data (PORTJ)
$0018
PJ7
PJ6
PJ5
PJ4
PJ3
PJ2
PJ1
PJ0
0000 0000
Address
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
State
on reset
Port A data direction (DDRA)
$0004
0000 0000
Port B data direction (DDRB)
$0005
0000 0000
Port C data direction (DDRC)
$0006
0000 0000
Port D data direction (DDRD)
$0007
0000 0000
Port E data direction (DDRE)
$000B
0000 0000
TPG
45
05F32Book Page 7 Tuesday, June 8, 1999 7:55 am
相关PDF资料 |
PDF描述 |
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参数描述 |
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