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参数资料
| 型号： | MC68HC05F32CFU |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 1.789 MHz, MICROCONTROLLER, PQFP80 |
| 封装： | QFP-80 |
| 文件页数： | 47/198页 |
| 文件大小： | 2335K |
| 代理商： | MC68HC05F32CFU |
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MOTOROLA
14-8
MC68HC05F32
RESETS AND INTERRUPTS
14
14.2.3.7
Custom periodic interrupt (CPI)
There is a timer interrupt ag that causes a CPI interrupt from the 32 kHz clock system whenever
set and enabled. The interrupt ag and enable bits are located in the CPI control and status
register (CPICSR). An interrupt will vector to the same interrupt service routine as the core timer
interrupts, located at the address specied by the contents of memory location $FFF8 and $FFF9.
14.2.4
Hardware controlled interrupt sequence
The following three functions (RESET, STOP, and WAIT) are not in the strictest sense interrupts.
However, they are acted upon in a similar manner. Flowcharts for STOP and WAIT are shown in
RESET: A reset condition causes the program to vector to its starting address, which is contained
in memory locations $FFFE (MSB) and $FFFF (LSB). The I-bit in the condition code register is
also set, to disable interrupts.
STOP: The STOP instruction causes the oscillator to be turned off and the processor to ‘sleep’ until
an external interrupt (IRQ), a low voltage interrupt (LVI), a custom periodic interrupt (CPI), or a
keyboard interrupt occurs, or the device is reset.
WAIT: The WAIT instruction causes all processor clocks to stop, but leaves the timer clocks
running. This ‘rest’ state of the processor can be cleared by reset, an external interrupt (IRQ), a
keyboard interrupt, a timer interrupt (core or 16-bit), or a CPI, SPI, SCI, LVI interrupt. There are no
special WAIT vectors for these interrupts.
TPG
134
05F32Book Page 8 Tuesday, June 8, 1999 7:55 am
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
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