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参数资料
| 型号： | MC68HC05F32CFU |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 1.789 MHz, MICROCONTROLLER, PQFP80 |
| 封装： | QFP-80 |
| 文件页数： | 28/198页 |
| 文件大小： | 2335K |
| 代理商： | MC68HC05F32CFU |
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MC68HC05F32
MOTOROLA
11-15
SERIAL COMMUNICATIONS INTERFACE
11
SCP1, SCP0 — Serial prescaler select bits
These read/write bits determine the prescale factor by which the internal processor clock is divided
before it is applied to the transmitter and receiver rate control dividers. This common prescaled
output is used as the input to a divider that is controlled by the SCR0–SCR2 bits for the SCI
receiver and transmitter.
SCR2, SCR1, SCR0 — SCI rate select bits
These three read/write bits select the baud rates for the transmitter and the receiver. The prescaler
output is divided by the factors shown in Table 11-3.
RCKB — SCI receive baud rate clock test
This bit is disabled and remains low in any mode other than test or bootstrap. Reset clears this bit.
While in test or bootstrap mode, this bit may be written but not read (reads always return a logic
zero). Setting this bit enables a baud rate counter test mode, where the exclusive-or of the receiver
clock (16 times the baud rate) is driven out of the PC3/TDO pin. This control bit is intended only
for factory testing of the MCU.
Table 11-2 First prescaler stage
SCP1
SCP0
Prescaler
division ratio (PRS1)
00
1
01
3
10
4
11
13
Table 11-3 Second prescaler stage
SCR2
SCR1
SCR0
Prescaler
division ratio (PRS2)
000
1
001
2
010
4
011
8
100
16
101
32
110
64
111
128
TPG
117
05F32Book Page 15 Tuesday, June 8, 1999 7:55 am
相关PDF资料 |
PDF描述 |
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参数描述 |
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