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参数资料
| 型号： | MC68HC05F4CP |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 1.789 MHz, MICROCONTROLLER, PDIP28 |
| 封装： | PLASTIC, DIP-28 |
| 文件页数： | 74/130页 |
| 文件大小： | 2089K |
| 代理商： | MC68HC05F4CP |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页当前第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页
MOTOROLA
5-4
MC68HC05F4
CORE TIMER
5
RTOF — Reset timer overow ag
Writing a ‘1’ to this bit clears the timer overow ag, CTOF. See CTOF description.
RRTIF — Reset real time overow ag
Wrting a ‘1’ to this bit clears the real time interrupt ag, RTIF. See RTIF description.
RT1, RT0 — Real time interrupt rate select
These two bits select one of four taps from the real time interrupt circuitry. Reset sets both RT0
and RT1 to one, selecting the lowest periodic rate and therefore the maximum time in which to
alter them if necessary. The COP reset times are also determined by these two bits. Care should
be taken when altering RT0 and RT1 if a timeout is imminent, or the timeout period is uncertain.
If the selected tap is modied during a cycle in which the counter is switching, an RTIF could be
missed or an additional one could be generated. To avoid problems, the COP should be cleared
before changing the RTI taps. See Table 5-1 for some example RTI periods.
5.2.2
Core timer counter register (CTCR)
The core timer counter register is a read-only register, which contains the current value of the 8-bit
ripple counter at the beginning of the timer chain. Reset clears this register.
Table 5-1 Example RTI periods
RTI Rates at fOP Frequency Specied
RT1 RT0
Division
ratio
16.384 kHz
447 kHz
895 kHz
1.789 MHz
00
214
1 s
36.7 ms
18.35 ms
9.17 ms
01
215
2 s
73.4 ms
36.7 ms
18.35 ms
10
216
4 s
146.8 ms
73.4 ms
36.7 ms
11
217
8 s
293.6 ms
146.8 ms
73.4 ms
Address
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
State
on reset
Core timer counter (CTCR)
$0009
0000 0000
TPG
44
05F4Book Page 4 Tuesday, August 5, 1997 1:10 pm
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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