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参数资料
| 型号： | MC68HC705G1FU |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 2.1 MHz, MICROCONTROLLER, PQFP64 |
| 封装： | QFP-64 |
| 文件页数： | 97/124页 |
| 文件大小： | 732K |
| 代理商： | MC68HC705G1FU |
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MOTOROLA
8-8
MC68HC05G1
SERIAL PERIPHERAL INTERFACE
8
8.4.1.2
SPE - Serial Peripheral Output Enable
1 (set)
–
Port D pins 2, 3, 4, 5 congured as SPI pins
0 (clear) –
Port D pins 2, 3, 4, 5 congured as standard I/O pins
When the serial peripheral output enable control bit is set, all output drive is applied to the external
pins and the system is enabled. When the SPE bit is set, it enables the SPI system by connecting
it to the external pins thus allowing it to interface with the external SPI bus. The pins that are
dened as output depend on which mode (master or slave) the device is in. Because the SPI bit
is cleared by reset, the SPI system is not connected to the external pins upon reset.
8.4.1.3
MSTR - Master
1 (set)
–
SPI congured as master
0 (clear) –
SPI congured as slave
The master bit determines whether the device is a master or a slave. If the MSTR bit is a logic zero
it indicates a slave device and a logic one denotes a master device. If the master mode is selected,
the function of the SCK pin changes from an input to an output and the function of the MSIO and
MOSI pins are reversed. This allows the user to wire device pins MISO to MISO, and MOSI to
MOSI, and SCK to SCK without incident. The MSTR bit is cleared by reset; therefore, the device
is always placed in the slave mode during reset.
Figure 8-4 SPI Master-Slave Interconnection
8-BIT SHIFT REGISTER
SPI
MASTER
SLAVE
MISO
MOSI
SS
MISO
MOSI
SS
SCK
8-BIT SHIFT REGISTER
CLOCK GENERATOR
5V
0V
TPG
70
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