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参数资料
| 型号： | MC9328MXSVP10 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 19/74页 |
| 文件大小： | 0K |
| 描述： | IC MCU I.MXS 100MHZ 225-MAPBGA |
| 标准包装： | 160 |
| 系列： | i.MXS |
| 核心处理器： | ARM9 |
| 芯体尺寸： | 32-位 |
| 速度： | 100MHz |
| 连通性： | EBI/EMI，I²C，SPI，SSI，UART/USART，USB |
| 外围设备： | DMA，I²S，LCD，POR，PWM，WDT |
| 输入/输出数： | 97 |
| 程序存储器类型： | ROMless |
| 电压 - 电源 (Vcc/Vdd)： | 1.7 V ~ 3.3 V |
| 振荡器型： | 外部 |
| 工作温度： | 0°C ~ 70°C |
| 封装/外壳： | 225-LFBGA |
| 包装： | 托盘 |
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Functional Description and Application Information
MC9328MXS Technical Data, Rev. 3
26
Freescale Semiconductor
4.4.2.2
WAIT Read Cycle DMA Enabled
Figure 7. DTACK WAIT Read Cycle DMA Enabled
Table 14. DTACK WAIT Read Cycle DMA Enabled: WSC = 111111, DTACK_SEL=1, HCLK=96MHz
Number
Characteristic
3.0 ± 0.3 V
Unit
Minimum
Maximum
1OE and EB assertion time
See note 2
–
ns
2CS pulse width
3T
–
ns
3OE negated before CS5 is negated
1.5T-0.68
1.5T-0.06
ns
4
Address inactived before CS negated
–
0.05
ns
5
Wait asserted after CS5 asserted
–
1020T
ns
6Wait asserted to OE negated
2T+1.57
3T+7.33
ns
7
Data hold timing after OE negated
T-1.49
–
ns
8
Data ready after wait is asserted
–
T
ns
9CS deactive to next CS active
T
–
ns
10
OE negate after EB negate
0.06
0.18
ns
11
Wait becomes low after CS5 asserted
0
1019T
ns
RW
WAIT
Address
EB
CS5
OE
(logic high)
DATABUS
programmable
min 0ns
1
2
3
8
9
5
6
7
11
10
12
4
S
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
| MC9328MXSVP10 | 制造商:Freescale Semiconductor 功能描述:Microprocessor |
| MC9328MXSVP10R2 | 功能描述:处理器 - 专门应用 REDUCED FEATURE CORSICA RoHS:否 制造商:Freescale Semiconductor 类型:Multimedia Applications 核心:ARM Cortex A9 处理器系列:i.MX6 数据总线宽度:32 bit 最大时钟频率:1 GHz 指令/数据缓存: 数据 RAM 大小:128 KB 数据 ROM 大小: 工作电源电压: 最大工作温度:+ 95 C 安装风格:SMD/SMT 封装 / 箱体:MAPBGA-432 |
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