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参数资料
| 型号： | MCF5275CVM133 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 133 MHz, RISC PROCESSOR, PBGA256 |
| 封装： | MAPBGA-256 |
| 文件页数： | 21/44页 |
| 文件大小： | 1242K |
| 代理商： | MCF5275CVM133 |
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MCF5275 Integrated Microprocessor Family Hardware Specification, Rev. 2
Preliminary—Subject to Change Without Notice
Preliminary Electrical Characteristics
Freescale Semiconductor
28
Figure 10. SRAM Read Bus Cycle Terminated by TEA
8.8
DDR SDRAM AC Timing Characteristics
The DDR SDRAM controller uses SSTL2 and I/O drivers. Either Class I or Class II drive strength is
available and is user programmable. DDR Clock timing specifications are given in Table 14 and Figure 11.
Table 14. DDR Clock Timing Specifications1
Symbol
Characteristic
Min
Max
Unit
VMP
Clock output mid-point voltage
1.05
1.45
V
VOUT
Clock output voltage level
-0.3
SDVDD + 0.3
V
VID
Clock output differential voltage (peak to peak swing)
0.7
SDVDD + 0.6
V
VIX
Clock crossing point voltage
1.05
1.45
V
CLKOUT
CSn
A[23:0]
OE
R/W
BS[3:2]
TEA
(H)
S0
S2
S3
S1
S4
S5
S0
S1
TA (H)
B6a
B8
B7a
B9
B6c
B7
B6b
B7
B2a
B1a
D[31:16]
B8
B9
TS
B9
TIP
B8
TSIZ[1:0]
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PDF描述 |
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