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参数资料
| 型号： | MCF5275CVM133 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 133 MHz, RISC PROCESSOR, PBGA256 |
| 封装： | MAPBGA-256 |
| 文件页数： | 29/44页 |
| 文件大小： | 1242K |
| 代理商： | MCF5275CVM133 |
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Preliminary Electrical Characteristics
MCF5275 Integrated Microprocessor Family Hardware Specification, Rev. 2
Preliminary—Subject to Change Without Notice
Freescale Semiconductor
35
Figure 19. MII Serial Management Channel Timing Diagram
8.11.5
USB Interface AC Timing Specifications
Table 22 lists USB Interface timings.
Table 21. MII Serial Management Channel Timing
Num
Characteristic
Min
Max
Unit
M10
FECn_MDC falling edge to FECn_MDIO output invalid (minimum
propagation delay)
0—
ns
M11
FECn_MDC falling edge to FECn_MDIO output valid (max prop delay)
—
25
ns
M12
FECn_MDIO (input) to FECn_MDC rising edge setup
10
—
ns
M13
FECn_MDIO (input) to FECn_MDC rising edge hold
0
—
ns
M14
FECn_MDC pulse width high
40%
60%
MDC period
M15
FECn_MDC pulse width low
40%
60%
MDC period
Table 22. USB Interface Timing
Num
Characteristic
Min
Max
Units
US1
USB_CLK frequency of operation
48
MHz
US2
USB_CLK fall time (VIH = 2.4 V to VIL = 0.5 V)
—
2
ns
US3
USB_CLK rise time (VIL = 0.5 V to VIH = 2.4 V)
—
2
ns
US4
USB_CLK duty cycle (at 0.5 x O VDD)45
55
%
Data Inputs
US5
USB_RP, USB_RN, USB_RXD valid to USB_CLK high
6
—
ns
M11
FECn_MDC (output)
FECn_MDIO (output)
M12
M13
FECn_MDIO (input)
M10
M14
M15
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