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参数资料
| 型号： | MCIMX253DJM4A |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 107/153页 |
| 文件大小： | 0K |
| 描述： | IC MPU IMX25 COMM 400MAPBGA |
| 标准包装： | 90 |
| 系列： | i.MX25 |
| 核心处理器： | ARM9 |
| 芯体尺寸： | 32-位 |
| 速度： | 400MHz |
| 连通性： | 1 线，EBI/EMI，以太网，I²C，MMC，智能卡，SPI，SSI，UART/USART，USB OTG |
| 外围设备： | DMA，I²S，LCD，POR，PWM，WDT |
| 输入/输出数： | 128 |
| 程序存储器类型： | 外部程序存储器 |
| RAM 容量： | 144K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 1.15 V ~ 1.52 V |
| 数据转换器： | A/D 3x12b |
| 振荡器型： | 外部 |
| 工作温度： | -20°C ~ 70°C |
| 封装/外壳： | 400-LFBGA |
| 包装： | 托盘 |
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i.MX25 Applications Processor for Consumer and Industrial Products, Rev. 10
Freescale Semiconductor
57
Figure 26. SDR SDRAM Write Cycle Timing Diagram
SD6
Address setup time
tAS
2.0
—
ns
SD7
Address hold time
tAH
1.8
—
ns
SD8
SDRAM access time
tAC
—
6.47
ns
SD9
Data out hold time2
tOH
1.2
—
ns
SD10
Active to read/write command period
tRC
10
—
clock
1 SD1 + SD2 does not exceed 7.5 ns for 133 MHz.
2 Timing parameters are relevant only to SDR SDRAM. For the specific DDR SDRAM data related timing parameters, see
Table 44. DDR/SDR SDRAM Read Cycle Timing Parameters (continued)
ID
Parameter
Symbol
Min.
Max.
Unit
CS
CAS
WE
RAS
ADDR
DQ
DQM
BA
ROW / BA
COL/BA
DATA
SD4
SD5
SD7
SD6
SD12
SD13
SD14
SD11
SDCLK
SD1
SD3
SD2
SDCLK
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