参数资料
型号: MCP6566RT-E/OT
厂商: Microchip Technology
文件页数: 5/30页
文件大小: 0K
描述: IC COMPARATOR O-D 1.8V SOT23-5
产品培训模块: MCP656x
标准包装: 1
类型: 通用
元件数: 1
输出类型: CMOS,开路漏极
电压 - 电源,单路/双路(±): 1.8 V ~ 5.5 V
电压 - 输入偏移(最小值): 10mV @ 5.5V
电流 - 输入偏压(最小值): 1pA @ 5.5V
电流 - 输出(标准): 50mA
电流 - 静态(最大值): 130µA
CMRR, PSRR(标准): 66dB CMRR,70dB PSRR
传输延迟(最大): 80ns
磁滞: 5mV
工作温度: -40°C ~ 125°C
封装/外壳: SC-74A,SOT-753
安装类型: 表面贴装
包装: 标准包装
产品目录页面: 681 (CN2011-ZH PDF)
其它名称: MCP6566RT-E/OTDKR
DS580F6
21
CS8406
Default = ‘00’
00 - OMCK frequency is 256*Fs
01 - OMCK frequency is 384*Fs
10 - OMCK frequency is 512*Fs
11 - OMCK frequency is 128*Fs
8.6
Serial Audio Input Port Data Format (05h)
SIMS - Master/Slave Mode Selector
Default = ‘0’
0 - Serial audio input port is in Slave Mode
1 - Serial audio input port is in Master Mode
SISF - ISCLK frequency (for Master Mode)
Default = ‘0’
0 - 64*Fs
1 - 128*Fs
SIRES1:0 - Resolution of the input data, for right-justified formats
Default = ‘00’
00 - 24-bit resolution
01 - 20-bit resolution
10 - 16-bit resolution
11 - Reserved
SIJUST - Justification of SDIN data relative to ILRCK
Default = ‘0’
0 - Left-justified
1 - Right-justified
SIDEL - Delay of SDIN data relative to ILRCK, for left-justified data formats
Default = ‘0’
0 - MSB of SDIN data occurs in the first ISCLK period after the ILRCK edge (Left-Justified Mode)
1 - MSB of SDIN data occurs in the second ISCLK period after the ILRCK edge (IS Mode)
SISPOL - ISCLK clock polarity
Default = ‘0’
0 - SDIN sampled on rising edges of ISCLK
1 - SDIN sampled on falling edges of ISCLK
SILRPOL - ILRCK clock polarity
Default = ‘0’
0 - SDIN data is for the left channel when ILRCK is high
1 - SDIN data is for the right channel when ILRCK is high
76
5
4
3
2
1
0
SIMS
SISF
SIRES1
SIRES0
SIJUST
SIDEL
SISPOL
SILRPOL
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