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参数资料
| 型号： | MPC8309VMAFDCA |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 333 MHz, RISC PROCESSOR, PBGA489 |
| 封装： | 19 X 19 MM, 1.61 MM HEIGHT, 0.80 MM PITCH, LEAD FREE, PLASTIC, MAPBGA-489 |
| 文件页数： | 43/81页 |
| 文件大小： | 484K |
| 代理商： | MPC8309VMAFDCA |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页当前第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页
MPC8309 PowerQUICC II Pro Integrated Communications Processor Family Hardware Specifications, Rev. 1
48
Freescale Semiconductor
JTAG
The following figure shows the SPI timing in slave mode (external clock).
Figure 37. SPI AC Timing in Slave Mode (External Clock) Diagram
The following figure shows the SPI timing in master mode (internal clock).
Figure 38. SPI AC Timing in Master Mode (Internal Clock) Diagram
21 JTAG
This section describes the DC and AC electrical specifications for the IEEE Std. 1149.1 (JTAG)
interface of the MPC8309.
21.1
JTAG DC Electrical Characteristics
The following table provides the DC electrical characteristics for the IEEE Std. 1149.1 (JTAG) interface
of the MPC8309.
Table 53. JTAG Interface DC Electrical Characteristics
Characteristic
Symbol
Condition
Min
Max
Unit
Output high voltage
VOH
IOH =–6.0mA
2.4
—
V
Output low voltage
VOL
IOL =6.0 mA
—
0.5
V
Output low voltage
VOL
IOL =3.2 mA
—
0.4
V
SPICLK (Input)
tNEIXKH
tNEIVKH
tNEKHOV
Input Signals:
SPIMOSI
(See Note)
Output Signals:
SPIMISO
(See Note)
Note:
The clock edge is selectable on SPI.
SPICLK (Output)
tNIIXKH
tNIKHOV
Input Signals:
SPIMISO
(See Note)
Output Signals:
SPIMOSI
(See Note)
Note:
The clock edge is selectable on SPI.
tNIIVKH
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