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参数资料
| 型号： | MPC9774FAR2 |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 7/14页 |
| 文件大小： | 0K |
| 描述： | IC PLL CLK GEN 1:14 3.3V 52-LQFP |
| 标准包装： | 1,500 |
| 类型： | PLL 时钟发生器 |
| PLL： | 带旁路 |
| 输入： | LVCMOS |
| 输出： | LVCMOS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:14 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 125MHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 52-LQFP |
| 供应商设备封装： | 52-TQFP（10x10） |
| 包装： | 带卷 (TR) |
MPC9774 REVISION 5 JANUARY 10, 2013
2
2013 Integrated Device Technology, Inc.
MPC9774 Data Sheet
3.3 V 1:14 LVCMOS PLL CLOCK GENERATOR
Figure 1. MPC9774 Logic Diagram
Figure 2. MPC9774 52-Lead Package Pinout (Top View)
PLL
Ref
FB
QA0
QA1
QA2
QA3
QA4
Bank A
VCO
2, 4
2, 4
4, 6
4, 6, 8, 12
CCLK0
1
0
200–500 MHz
CCLK1
Bank B
1
0
Bank C
QFB
CCLK_SEL
FB_IN
VCO_SEL
FSEL_A
FSEL_B
FSEL_C
FSEL_FB[1:0]
2
VCC
PLL_EN
1
0
2
4
QB0
QB1
QB2
QB3
QB4
QC0
QC1
QC2
QC3
Stop
CLK
VCC
All input resistors have a value of 25 k
VCC
Power-On Reset
CLK_STOP
MR/OE
Stop
CLK
Stop
CLK
QB0
VCC
NC
GND
QC3
VCC
QC2
GND
QC1
VCC
QC0
GND
VCO_SEL
VCC
QA0
GND
QA1
VCC
QA2
FSEL_FB1
GND
QA3
VCC
QA4
GND
FSEL_FB0
GND
QB1
V
CC
QB2
GND
QB3
V
CC
QB4
FB
_IN
GND
QFB
V
CC
NC
GND
MR
/OE
CLK_ST
OP
FSEL_
B
FSEL_
C
PLL_
EN
FSEL_
A
CCLK_SE
L
CCLK
0
CCLK
1
V
CC_PLL
NC
V
CC
40
41
42
43
44
45
46
47
48
49
50
51
52
25
24
23
22
21
20
19
18
17
16
15
14
1 2 3 4 5 6 7 8 9 101112 13
39 38 37 36 35 34 33 32 31 30 29 28 27
26
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