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参数资料
| 型号： | mPD789322 |
| 厂商： | NEC Corp. |
| 元件分类： | 8位微控制器 |
| 英文描述： | 8-bit Microcontroller with 2/4/8K Bytes In-System Programmable Flash |
| 中文描述： | 8位微控制器与2/4/8K字节在系统可编程闪存 |
| 文件页数： | 74/96页 |
| 文件大小： | 482K |
| 代理商： | MPD789322 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页当前第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页
Preliminary Product Information U14673EJ1V0PM00
76
PD789322,789324,789326,789327
Flag
Mnemonic
Operand
Byte
Clock
Operation
ZAC CY
A, #byte
2
4
A
← A ∨ byte
×
saddr, #byte
3
6
(saddr)
← (saddr) ∨ byte
×
A, r
2
4
A
← A ∨ r
×
A, saddr
2
4
A
← A ∨ (saddr)
×
A, !addr16
3
8
A
← A ∨ (addr16)
×
A, [HL]
1
6
A
← A ∨ (HL)
×
OR
A, [HL + byte]
2
6
A
← A ∨ (HL + byte)
×
A, #byte
2
4
A
← A byte
×
saddr, #byte
3
6
(saddr)
← (saddr) byte
×
A, r
2
4
A
← A r
×
A, saddr
2
4
A
← A (saddr)
×
A, !addr16
3
8
A
← A (addr16)
×
A, [HL]
1
6
A
← A (HL)
×
XOR
A, [HL + byte]
2
6
A
← A (HL + byte)
×
A, #byte
2
4
A
byte
×× ×
saddr, #byte
3
6
(saddr)
byte
×× ×
A, r
2
4
A
r
×× ×
A, saddr
2
4
A
(saddr)
×× ×
A, !addr16
3
8
A
(addr16)
×× ×
A, [HL]
1
6
A
(HL)
×× ×
CMP
A, [HL + byte]
2
6
A
(HL + byte)
×× ×
ADDW
AX, #word
3
6
AX, CY
← AX + word
×× ×
SUBW
AX, #word
3
6
AX, CY
← AX word
×× ×
CMPW
AX, #word
3
6
AX
word
×× ×
r2
4
r
← r + 1
××
INC
saddr
2
4
(saddr)
← (saddr) + 1
××
r2
4
r
← r 1
××
DEC
saddr
2
4
(saddr)
← (saddr) 1
××
INCW
rp
1
4
rp
← rp + 1
DECW
rp
1
4
rp
← rp 1
ROR
A, 1
1
2
(CY, A7
← A0, Am1 ← Am) × 1
×
ROL
A, 1
1
2
(CY, A0
← A7, Am+1 ← Am) × 1
×
RORC
A, 1
1
2
(CY
← A0, A7 ← CY, Am1 ← Am) × 1
×
ROLC
A, 1
1
2
(CY
← A7, A0 ← CY, Am+1 ← Am) × 1
×
Remark The instruction clock cycle is based on the CPU clock (fCPU) specified by the processor clock control
register (PCC).
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PDF描述 |
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