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参数资料
| 型号： | mPD789322 |
| 厂商： | NEC Corp. |
| 元件分类： | 8位微控制器 |
| 英文描述： | 8-bit Microcontroller with 2/4/8K Bytes In-System Programmable Flash |
| 中文描述： | 8位微控制器与2/4/8K字节在系统可编程闪存 |
| 文件页数： | 76/96页 |
| 文件大小： | 482K |
| 代理商： | MPD789322 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页当前第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页
Preliminary Product Information U14673EJ1V0PM00
78
PD789322,789324,789326,789327
Flag
Mnemonic
Operand
Byte
Clock
Operation
ZAC CY
BC
$addr16
2
6
PC
← PC + 2 + jdisp8 if CY = 1
BNC
$addr16
2
6
PC
← PC + 2 + jdisp8 if CY = 0
BZ
$addr16
2
6
PC
← PC + 2 + jdisp8 if Z = 1
BNZ
$addr16
2
6
PC
← PC + 2 + jdisp8 if Z = 0
saddr.bit, $addr16
4
10
PC
← PC + 4 + jdisp8
if (saddr.bit) = 1
sfr.bit, $addr16
4
10
PC
← PC + 4 + jdisp8 if sfr.bit = 1
A.bit, $addr16
3
8
PC
← PC + 3 + jdisp8 if A.bit = 1
BT
PSW.bit, $addr16
4
10
PC
← PC + 4 + jdisp8 if PSW.bit = 1
saddr.bit, $addr16
4
10
PC
← PC + 4 + jdisp8
if (saddr.bit) = 0
sfr.bit, $addr16
4
10
PC
← PC + 4 + jdisp8 if sfr.bit = 0
A.bit, $addr16
3
8
PC
← PC + 3 + jdisp8 if A.bit = 0
BF
PSW.bit, $addr16
4
10
PC
← PC + 4 + disp8 if PSW.bit = 0
B, $addr16
2
6
B
← B 1, then
PC
← PC + 2 + jdisp8 if B ≠ 0
C, $addr16
2
6
C
← C 1, then
PC
← PC + 2 + jdisp8 if C ≠ 0
DBNZ
saddr, $addr16
3
8
(saddr)
← (saddr) 1, then
PC
← PC + 3 + jdisp8 if (saddr) ≠ 0
NOP
1
2
No Operation
EI
3
6
IE
← 1 (Enable Interrupt)
DI
3
6
IE
← 0 (Disable Interrupt)
HALT
1
2
Set HALT Mode
STOP
1
2
Set STOP Mode
Remark The instruction clock cycle is based on the CPU clock (fCPU) specified by the processor clock control
register (PCC).
相关PDF资料 |
PDF描述 |
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