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参数资料
| 型号： | MSC7119VM1200 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 50/60页 |
| 文件大小： | 0K |
| 描述： | DSP 16BIT W/DDR CTRLR 400-MAPBGA |
| 标准包装： | 90 |
| 系列： | StarCore |
| 类型： | 定点 |
| 接口： | 主机接口，I²C，UART |
| 时钟速率： | 300MHz |
| 非易失内存： | ROM（8 kB） |
| 芯片上RAM： | 464kB |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 1.20V |
| 工作温度： | -40°C ~ 105°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 400-LFBGA |
| 供应商设备封装： | 400-MAPBGA（17x17） |
| 包装： | 托盘 |
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MSC7119 Data Sheet, Rev. 8
Hardware Design Considerations
Freescale Semiconductor
54
3.5
DDR Memory System Guidelines
MSC7119 devices contain a memory controller that provides a glueless interface to external double data rate (DDR) SDRAM
memory modules with Class 2 Series Stub Termination Logic 2.5 V (SSTL_2). There are two termination techniques, as shown
in Figure 36. Technique B is the most popular termination technique.
Figure 37 illustrates the power wattage for the resistors. Typical values for the resistors are as follows:
RS = 22
Ω
RT = 24
Ω
Figure 36. SSTL Termination Techniques
Controller
Address
Command
Chip Selects
Data
Strobes
Mask
VREF
VT
T
e
rm
ina
tor
VTT
Generator
DDR
Bank
DDR
Bank
VTT
SSTL_2
RS
RT
RS
Controller
Address
Command
Chip Selects
Data
Strobes
Mask
VTT
T
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nat
or
Is
la
nd
VTT
Generator
DDR
Bank
DDR
Bank
SSTL_2
RS
RT
RS
Technique A
Technique B
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PDF描述 |
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参数描述 |
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