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参数资料
| 型号： | MSC7119VM1200 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 55/60页 |
| 文件大小： | 0K |
| 描述： | DSP 16BIT W/DDR CTRLR 400-MAPBGA |
| 标准包装： | 90 |
| 系列： | StarCore |
| 类型： | 定点 |
| 接口： | 主机接口，I²C，UART |
| 时钟速率： | 300MHz |
| 非易失内存： | ROM（8 kB） |
| 芯片上RAM： | 464kB |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 1.20V |
| 工作温度： | -40°C ~ 105°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 400-LFBGA |
| 供应商设备封装： | 400-MAPBGA（17x17） |
| 包装： | 托盘 |
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Revision History
MSC7119 Data Sheet, Rev. 8
Freescale Semiconductor
59
7
Revision History
Table 36 provides a revision history for this data sheet.
Table 36. Document Revision History
Revision
Date
Description
0
Sep. 2005
Initial public release.
1
Oct 2005
Added explanatory note to HDI16 timing table.
2
Oct. 2005
Added information about signals GPIOB11, GPIOC11, GPIOD7, and GPIOD8 to the signal descriptions
and pinout location lists.
3
Dec. 2005
Added information about signals GPIOA16, GPIOA17, GPIOA27, GPIOA28, and GPIOA29 to signal
description and pinout location lists.
4
Feb. 2006
Updated orderable part numbers.
5
Nov. 2006
Updated Reference Manual reference to MSC711x Reference Manual.
Updated arrows in Host DMA Writing Timing figure.
6
Jun. 2007
Updated to new data sheet format. Reorganized and renumbered sections, figures, and tables.
Added a note to clarify the definition of TCK timing 700 in new Table 31.
Removed references to VCCSYN and VCCSYN1 in the new power supply design recommendation Section
3.2.
7
Aug 2007
The power-up and power-down sequences described in Section 3.2 starting on page 42 have been expanded
to five possible design scenarios/cases. These cases replace the previously recommended
power-up/power-down sequence recommendations. Section 3.2 has been clarified by adding subsection
headings.
8
Apr 2008
Change the PLL filter resistor from 20
Ω to 2 Ω in Section 3.2.5.
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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